參數(shù)資料
型號(hào)： EP2C20F256I6N
廠商： ALTERA CORP
元件分類： FPGA
英文描述： FPGA, 1196 CLBS, PBGA256
封裝： LEAD FREE, FBGA-256
文件頁數(shù)： 50/168頁
文件大?。?/td> 2206K
代理商： EP2C20F256I6N
Altera Corporation
5–53
February 2008
Cyclone II Device Handbook, Volume 1
DC Characteristics and Timing Specifications
SSTL_2_CLASS_II
16 mA
42
43
45
15
29
42
15
29
42
20 mA
41
42
44
——————
24 mA
40
42
43
——————
SSTL_18_
CLASS_I
6 mA
20
22
24
46
47
49
46
47
49
8 mA
20
22
24
47
49
51
47
49
51
10 mA
20
22
25
23
25
27
23
25
27
12 mA
19
23
26
——————
SSTL_18_ CLASS_II
16 mA
30
33
36
——————
18 mA
29
——————
1.8V_HSTL_ CLASS_I
8 mA
26
28
29
59
61
63
59
61
63
10 mA
46
47
48
65
66
68
65
66
68
12 mA
67
71
72
71
72
1.8V_HSTL_ CLASS_II
16 mA
62
65
68
——————
18 mA
59
62
65
——————
20 mA
57
59
62
——————
1.5V_HSTL_ CLASS_I
8 mA
40
41
28
32
36
28
32
36
10 mA
41
42
——————
12 mA
43
——————
1.5V_HSTL_ CLASS_II
16 mA
18
20
21
——————
DIFFERENTIAL_SSTL_2
_CLASS_I
8 mA
46
47
49
25
40
56
25
40
56
12 mA
67
69
70
23
42
60
23
42
60
DIFFERENTIAL_SSTL_2
_CLASS_II
16 mA
42
43
45
15
29
42
15
29
42
20 mA
41
42
44
——————
24 mA
40
42
43
——————
DIFFERENTIAL_SSTL_
18_CLASS_I
6 mA
20
22
24
46
47
49
46
47
49
8 mA
20
22
24
47
49
51
47
49
51
10 mA
20
22
25
23
25
27
23
25
27
12 mA
19
23
26
——————
Table 5–46. Maximum Output Clock Toggle Rate Derating Factors (Part 2 of 4)
I/O Standard
Drive
Strength
Maximum Output Clock Toggle Rate Derating Factors (ps/pF)
Column I/O Pins
Row I/O Pins
Dedicated Clock
Outputs
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
相關(guān)PDF資料
PDF描述
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EP2SGX60CF780C4 FPGA, 60440 CLBS, 717 MHz, PBGA780
EP2SGX60CF780C5N FPGA, 60440 CLBS, 640 MHz, PBGA780
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