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參數(shù)資料
| 型號(hào)： | EP2C20F256I6N |
| 廠商： | ALTERA CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1196 CLBS, PBGA256 |
| 封裝： | LEAD FREE, FBGA-256 |
| 文件頁數(shù)： | 87/168頁 |
| 文件大?。?/td> | 2206K |
| 代理商： | EP2C20F256I6N |
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Altera Corporation
2–13
February 2007
Cyclone II Device Handbook, Volume 1
Cyclone II Architecture
Figure 2–9. Register Chain Interconnects
The C4 interconnects span four LABs, M4K blocks, or embedded
multipliers up or down from a source LAB. Every LAB has its own set of
C4 interconnects to drive either up or down. Figure 2–10 shows the C4
interconnect connections from an LAB in a column. The C4 interconnects
can drive and be driven by all types of architecture blocks, including
PLLs, M4K memory blocks, embedded multiplier blocks, and column
and row IOEs. For LAB interconnection, a primary LAB or its LAB
neighbor (see Figure 2–10) can drive a given C4 interconnect. C4
interconnects can drive each other to extend their range as well as drive
row interconnects for column-to-column connections.
LE 1
LE 2
LE 3
LE 4
LE 5
LE 6
LE 7
LE 8
LE 9
LE 10
LE 11
LE 12
LE13
LE 14
LE 15
LE 16
Carry Chain
Routing to
Adjacent LE
Local
Interconnect
Register Chain
Routing to Adjacent
LE's Register Input
Local Interconnect
Routing Among LEs
in the LAB
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| EP2SGX60CF780C4 | FPGA, 60440 CLBS, 717 MHz, PBGA780 |
| EP2SGX60CF780C5N | FPGA, 60440 CLBS, 640 MHz, PBGA780 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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