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參數(shù)資料
| 型號： | EP2C20F256I6N |
| 廠商： | ALTERA CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1196 CLBS, PBGA256 |
| 封裝： | LEAD FREE, FBGA-256 |
| 文件頁數(shù)： | 70/168頁 |
| 文件大?。?/td> | 2206K |
| 代理商： | EP2C20F256I6N |
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Altera Corporation
5–71
February 2008
Cyclone II Device Handbook, Volume 1
DC Characteristics and Timing Specifications
2.5-V
140
155
ps
1.8-V
115
165
ps
1.5-V
745
770
ps
SSTL-2 Class I
60
75
ps
SSTL-2 Class II
60
80
ps
SSTL-18 Class I
60
130
ps
SSTL-18 Class II
60
135
ps
HSTL-18 Class I
60
115
ps
HSTL-18 Class II
75
100
ps
HSTL-15 Class I
150
ps
HSTL-15 Class II
135
155
ps
Differential SSTL-2 Class I
60
75
ps
Differential SSTL-2 Class II
60
80
ps
Differential SSTL-18 Class I
60
130
ps
Differential SSTL-18 Class II
60
135
ps
Differential HSTL-18 Class I
60
115
ps
Differential HSTL-18 Class II
75
100
ps
Differential HSTL-15 Class I
150
ps
Differential HSTL-15 Class II
135
155
ps
LVDS
60
ps
Simple RSDS
60
70
ps
Mini-LVDS
60
ps
Notes to Table 5–56:
(1)
The DCD specification is characterized using the maximum drive strength
available for each I/O standard.
(2)
Numbers are applicable for commercial, industrial, and automotive devices.
Table 5–57. Maximum for DDIO Output on Row Pins with PLL in the Clock
Path
Row Pins with PLL in the Clock Path
C6
C7
C8
Unit
LVCMOS
270
310
ps
LVTTL
285
305
335
ps
2.5-V
180
220
ps
1.8-V
165
175
205
ps
Table 5–56. Maximum DCD for SDR Output on Column I/O Notes (1), (2)
(Part 2 of 2)
Column I/O Output Standard
C6
C7
C8
Unit
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP2SGX60CF780C3N | FPGA, 60440 CLBS, 717 MHz, PBGA780 |
| EP2SGX60CF780C3 | FPGA, 60440 CLBS, 717 MHz, PBGA780 |
| EP2SGX60CF780C4N | FPGA, 60440 CLBS, 717 MHz, PBGA780 |
| EP2SGX60CF780C4 | FPGA, 60440 CLBS, 717 MHz, PBGA780 |
| EP2SGX60CF780C5N | FPGA, 60440 CLBS, 640 MHz, PBGA780 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EP2C20F256I8GA | 制造商:Altera Corporation 功能描述: |
| EP2C20F256I8N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 152 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2C20F484C6 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 315 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2C20F484C6N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 315 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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