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參數(shù)資料
| 型號(hào)： | QADCRM |
| 英文描述： | Queued Analog-to-Digital Converter Reference Manual |
| 中文描述： | 排隊(duì)模擬到數(shù)字轉(zhuǎn)換器參考手冊(cè) |
| 文件頁(yè)數(shù)： | 101/122頁(yè) |
| 文件大?。?/td> | 940K |
| 代理商： | QADCRM |
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QADC
REFERENCE MANUAL
REGISTER SUMMARY
MOTOROLA
B-1
APPENDIX B REGISTER SUMMARY
B.1 Address Map
B.2 QADC Registers
The following section provides a summary of QADC registers and their content.
B.2.1 QADC Module Configuration Register
STOP — Stop Enable
0 = Disable stop mode
1 = Enable stop mode
NOTES:
1. S = Supervisor only
2. U = Unrestricted or supervisor depending on the state of the SUPV bit in the QADCMCR.
Table B-1 QADC Address Map
Access
S
1
S
S
S/U
2
S/U
S/U
S/U
S/U
S/U
—
Address
$####00
$####02
$####04
$####06
$####08
$####0A
$####0C
$####0E
$####10
$####12–
$####2E
$####30–
$####7E
$####80–
$####AE
$####B0–
$####FE
$####00–
$####2E
$####30–
$####7E
$####80–
$####AE
$####B0–
$####FE
Offset
$000
$002
$004
$006
$008
$00A
$00C
$00E
$010
$012–
$02E
$030–
$07E
$080–
$0AE
$0B0–
$0FE
$100–
$12E
$130–
$17E
$180–
$1AE
$1B0–
$1FE
15 8
MODULE CONFIGURATION REGISTER (QADCMCR)
TEST REGISTER (QADCTEST)
INTERRUPT REGISTER (QADCINT)
PORT A DATA (PORTQA)
PORT DATA DIRECTION REGISTER (DDRQA)
CONTROL REGISTER 0 (QACR0)
CONTROL REGISTER 1 (QACR1)
CONTROL REGISTER 2 (QACR2)
STATUS REGISTER (QASR)
RESERVED
7 0
PORT B DATA (PORTQB)
S/U
CONVERSION COMMAND WORD (CCW) TABLE
—
RESERVED
S/U
RESULT WORD TABLE
RIGHT JUSTIFIED, UNSIGNED RESULT REGISTER (RJURR)
RESERVED
—
S/U
RESULT WORD TABLE
LEFT JUSTIFIED, SIGNED RESULT REGISTER (LJSRR)
RESERVED
—
S/U
RESULT WORD TABLE
LEFT JUSTIFIED, UNSIGNED RESULT REGISTER (LJURR)
QADCMCR —
Module Configuration Register
$####00
15
14
FRZ
13
12
11
NOT USED
10
9
8
7
6
5
4
3
2
1
0
STOP
RESET:
0
SUPV
NOT USED
IARB
0
1
0
0
0
0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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