參數(shù)資料
型號(hào)： TMUX03155
英文描述： TMUX03155 STS-3/STM-1 (AU-4) Multiplexer/Demultiplexer
中文描述： TMUX03155 STS-3/STM-1（非盟- 4）復(fù)用器/解復(fù)用器
文件頁(yè)數(shù)： 87/120頁(yè)
文件大?。?/td> 1542K
代理商： TMUX03155
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Agere Systems Inc.
87
Data Sheet
April 2001
TMUX03155 STS-3/STM-1 (AU-4) Multiplexer/Demultiplexer
Microprocessor Interface
(continued)
Register Map
(continued)
Table 69. Register 99: Receive Low-Speed BIP Error Insert (R/W)
Table 70. Registers 100—102: Receive Low-Speed Overhead Control Bits (R/W)
Address
Dec (Hex)
99 (0x63)
Bit
Name
Function
Reset
Default
000
5—3
RB2ERRINS[3—1]
Receive B2 Error Insert Control.
Control bit, when
set to a logic 1, causes the respective B2 byte in the
outgoing STS-1/AU-3 signal to be inverted.
Receive B1 Error Insert Control.
Control bit, when
set to a logic 1, causes the respective B1 byte in the
outgoing STS-1/AU-3 signal to be inverted.
99 (0x63)
2—0
RB1ERRINS[3—1]
000
Address
Dec (Hex)
100 (0x64)
Bit
Name
Function
Reset
Default
0
6
RH1H2CRUPPorNDF
Receive H1 H2 Corrupt or NDF.
Control bit, when
set to a logic 0, causes an invalid pointer to be
inserted into the output H1 and H2 bytes; otherwise,
a continuous NDF condition (1001) is forced in the
STS-1/AU-3 signal.
Receive H1 H2 Corrupt Enable.
Control bits, when
set to a logic 1, causes the output H1 and H2 bytes
of the STS-1/AU-3 signal to be corrupted as con-
trolled by register bit RH1H2CRUPPorNDF
in the
same register.
Receive F1 Data Insert.
Control bits, when set to a
logic 1, causes the RF1DINS[3—1][7:0], 0x6B—6D
values to be inserted into the respective output F1
bytes in the STS-1/AU-3 signals; otherwise, insert
the value set by the R_F1_PASS[3—1] control bit,
0x74.
RSFEBEERRINS[3—1]
Receive Section FEBE Error Insert.
Control bit,
when set to a logic 1, causes a Section FEBE (B2
Error value of 0x3) to be inserted into the STS-1/
AU-3 output signal; otherwise, an error is not
inserted.
RSFEBEINH[3—1]
Receive Section FEBE Hardware Inhibit.
Control
bit, when set to a logic 1, inhibits the hardware
insert of Section FEBE in the STS-1/AU-3 output
signal; otherwise, the default value is inserted.
RLAISINS[3—1]
Receive Line AIS Insert.
Control bit, when set to a
logic 1, forces L-AIS to be inserted into the outgoing
STS-1/AU-3 frame.
RAPSBABLEINS[3—1]
Receive APS Babble Insert.
Control bit, when set
to a logic 1, causes an inconsistent APS byte
(K1[7:0], K2[7:3]) to be inserted into the outgoing
STS-1/AU-3 frame.
100 (0x64)
5—3
RH1H2CRUPEN[3—1]
000
100 (0x64)
2—0
RF1INS[3—1]
000
101 (0x65)
5—3
000
101 (0x65)
2—0
000
102 (0x66)
5—3
000
102 (0x66)
2—0
000
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PDF描述
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TMV 0505DEN 制造商:Traco Power 功能描述:TMV 0505DEN
TMV 0505EN 制造商:Traco Power 功能描述:POWER SUPPLY, 5 VDC 200 MA 65 %
TMV 0505S 制造商:Traco Power 功能描述:DC/DC CONVERTERS, 1 WATT, 5 VDC
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