參數(shù)資料
型號： TMUX03155
英文描述： TMUX03155 STS-3/STM-1 (AU-4) Multiplexer/Demultiplexer
中文描述： TMUX03155 STS-3/STM-1（非盟- 4）復用器/解復用器
文件頁數(shù)： 91/120頁
文件大?。?/td> 1542K
代理商： TMUX03155
Agere Systems Inc.
91
Data Sheet
April 2001
TMUX03155 STS-3/STM-1 (AU-4) Multiplexer/Demultiplexer
Microprocessor Interface
(continued)
Register Map
(continued)
Table 80. Page 1 - Registers 134—140: STS-1/AU-3 B2 BIP Error Counters (RO)
Table 81. Page 1 - Registers 141—142: STS-3/STM-1 (AU-4) B1 Error Count (RO)
Table 82. Page 1 - Registers 143—145: STS-3/STM-1 (AU-4) B2 Error Count (RO)
Address
Dec (Hex)
137 (0x89)—
140 (0x8C)
Bit
Name
Function
Reset
Default
0x0000
7—0
TLSB2ECNT[2—3][15:8]
TLSB2ECNT[2—3][7:0]
Transmit Low-Speed B2 Error Count Ports 2
and 3.
These are the B2 BIP error rate counters.
These counters can either count actual BIP errors
or block errors (BITBLOCKCNT
,
0x34). These
counters hold at their maximum values and trans-
fer their internal counts to a holding register when
LATCH_CNT,
0x04
transitions from a logic 0 to 1.
Transmit Low-Speed B2 Error Count Port 1.
Same as above.
134 (0x86)
135 (0x87)
136 (0x88)
1—0
7—0
7—0
TLSB2ECNT[1][17:16]
TLSB2ECNT[1][15:8]
TLSB2ECNT[1][7:0]
0x00000
Address
Dec (Hex)
141 (0x8D)
142 (0x8E)
Bit
Name
Function
Reset
Default
0x0000
7—0
RHSB1ECNT[15:8]
RHSB1ECNT[7:0]
Receive High-Speed B1 Error Count.
Counts
the number of B1 errors in the received STS-3/
STM-1 (AU-4) frame. This counter can either
count actual BIP errors or block errors
(BITBLOCKCNT, 0x34). This counter holds at its
maximum value and transfers its internal count to
a holding register when LATCH_CNT, 0x04
tran-
sitions from a logic 0 to 1.
Address
Dec (Hex)
143 (0x8F)
144 (0x90)
145 (0x91)
Bit
Name
Function
Reset
Default
0x00000
1—0
7—0
7—0
RHSB2ECNT[17:16]
RHSB2ECNT[15:8]
RHSB2ECNT[7:0]
Receive High-Speed B2 Error Count.
Counts
the number of B2 errors in the received STS-3/
STM-1 (AU-4) frame. This counter can either
count actual BIP errors or block errors
(BITBLOCKCNT, 0x34). This counter holds at its
maximum value and transfers its internal count to
a holding register when LATCH_CNT,
0x04
tran-
sitions from a logic 0 to 1.
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參數(shù)描述
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