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參數(shù)資料
| 型號(hào)： | FW82371 |
| 廠商： | Intel Corp. |
| 英文描述： | PCI-TO-ISA / IDE XCELERATOR PIIX4 |
| 中文描述： | PCI到的ISA / IDE的XCELERATOR PIIX4 |
| 文件頁數(shù)： | 86/284頁 |
| 文件大?。?/td> | 1042K |
| 代理商： | FW82371 |
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82371AB (PIIX4)
E
86
4/9/97 2:23 PM PIIX4aDS
INTEL CONFIDENTIAL
(until publication date)
PRELIMINARY
4.2.6.
ADVANCED POWER MANAGEMENT (APM) REGISTERS
This section describes two power management registers—APMC and APMS Registers. These registers are
located in normal I/O space and must be accessed (via the PCI Bus) with 8-bit accesses.
4.2.6.1.
APMC—Advanced Power Management Control Port (IO)
I/O Address:
Default Value:
Attribute:
0B2h
00h
Read/Write
This register passes data (APM Commands) between the OS and the SMI handler. In addition, writes can
generate an SMI. PIIX4 operation is not affected by the data in this register.
Bit
Description
7:0
APM Control Port (APMC).
Writes to this register store data in the APMC Register and reads return
the last data written. In addition, writes generate an SMI, if the APMC_EN bit (PCI function 3, offset
58h, bit 25) is set to 1. Reads do not generate an SMI.
4.2.6.2.
APMS—Advanced Power Management Status Port (IO)
I/O Address:
Default Value:
Attribute:
0B3h
00h
Read/Write
This register passes status information between the OS and the SMI handler. PIIX4 operation is not affected by
the data in this register.
Bit
Description
7:0
APM Status Port (APMS).
Writes store data in this register and reads return the last data written.
4.2.7.
X-BUS, COPROCESSOR, AND RESET REGISTERS
4.2.7.1.
RIRQ—Reset X-Bus IRQ12/M and IRQ1 Register (IO)
I/O Address:
Default Value:
Attribute:
60h
N/A
Read only
This register clears the mouse interrupt function (IRQ12/M) and the keyboard interrupt (IRQ1). Reads and writes
to this address are accepted by PIIX4 and sent to ISA (Keyboard accesses must be enabled if in Positive
decode). PIIX4 latches low to high transitions on IRQ1 and IRQ12/M (when enabled as mouse interrupt). A read
of 60h clears the internally latched signals of IRQ1 and IRQ12/M.
Bit
Description
7:0
Reset IRQ12 and IRQ1.
No specific pattern. A read of address 60h clears the internally latched
IRQ1 and IRQ12/M signals.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FW82801E | Intel 82801E Communications I/O Controller Hub (C-ICH) |
| FWB150 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB151 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB1510 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB152 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| FW82371EB SL37M | 制造商:Intel 功能描述: |
| FW82371MB | 制造商:Rochester Electronics LLC 功能描述:PCI-ISA BRIDGE, T&R, SPEC SL3CG - Bulk |
| FW82439HX | 制造商:Intel 功能描述: |
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