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參數(shù)資料
| 型號(hào)： | PM5372-BI |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁(yè)數(shù)： | 31/169頁(yè) |
| 文件大小： | 989K |
| 代理商： | PM5372-BI |
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TSE Transmission Switch Element Datasheet
Released
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-1991258, Issue 7
31
8
Pin Description
Table 1 Pin Description LVDS Ports (256 Signals)
Pin Name
Type
Pin No.
Function
RP[1]
RN[1]
RP[2]
RN[2]
RP[3]
RN[3]
RP[4]
RN[4]
RP[5]
RN[5]
RP[6]
RN[6]
RP[7]
RN[7]
RP[8]
RN[8]
RP[9]
RN[9]
RP[10]
RN[10]
RP[11]
RN[11]
RP[12]
RN[12]
RP[13]
RN[13]
RP[14]
RN[14]
RP[15]
RN[15]
RP[16]
RN[16]
RP[17]
RN[17]
RP[18]
RN[18]
RP[19]
RN[19]
RP[20]
RN[20]
RP[21]
RN[21]
RP[22]
RN[22]
RP[23]
RN[23]
RP[24]
Analog
LVDS
Input
M4
M3
N3
N2
P2
P1
R3
R2
V4
V3
Y2
Y1
Y4
Y3
AA2
AA1
AE4
AE3
AF3
AF2
AG4
AG3
AG2
AG1
AL4
AL3
AL2
AL1
AM3
AM2
AN4
AN3
AT12
AU12
AU13
AV13
AV14
AW14
AU15
AV15
AT18
AU18
AV20
AW20
AT20
AU20
AV21
Receive Serial Data.
The differential receive serial data links
(RP[64:1]/RN[64:1]) carry the receive SONET/SDH STS-12 frame data
from upstream sources in bit serial format. Each differential pair
RP[
X
]/RN[
X
] carries a constituent STS-12 stream. Data on RP[
X
]/RN[
X
] is
encoded in an 8B/10B format extended from IEEE Std. 802.3. The 8B/10B
character bit ‘a(chǎn)’ is transmitted first and the bit ‘j’ is transmitted last. All
RP[
X
]/RN[
X
] differential pairs must be frequency locked and phase aligned
(within a certain tolerance) to each other. RP[64:1]/RN[64:1] are nominally
777.6 MHz data streams. Unused RP[X]/RN[X] pad pairs can be left
floating , or can be grounded. In either case the analog blocks (RXLV and
the DRU) can be disabled to reduce power consumption. Tying one pin
high and the corresponding pin of an input pair low will apply voltage
across the internal termination resistor, which will increase system power
consumption.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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