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參數(shù)資料
| 型號： | μPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Microprocessor(64位微處理器) |
| 中文描述： | 64位微處理器（64位微處理器） |
| 文件頁數(shù)： | 10/359頁 |
| 文件大小： | 1652K |
| 代理商： | ΜPD30101 |
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- iv -
3.3 LOAD DELAY........................................................................................................
3.4 PIPELINE OPERATION.........................................................................................
3.4.1 Add Instruction (Add rd, rs, rt)............................................................................................
3.4.2 Jump and Link Register Instruction (JALR rd, rs)...............................................................
3.4.3 Branch on Equal Instruction (BEQ rs, rt, offset).................................................................
3.4.4 Trap if Less Than Instruction (TLT rs, rt)............................................................................
3.4.5 Load Word Instruction (LW rt, offset (base))......................................................................
3.4.6 Store Word Instruction (SW rt, offset (base)).....................................................................
3.5 INTERLOCK AND EXCEPTION HANDLING.........................................................
3.5.1 Exception Conditions..........................................................................................................
3.5.2 Stall Conditions ..................................................................................................................
3.5.3 Slip Conditions ...................................................................................................................
3.5.4 Bypassing...........................................................................................................................
3.6 CODE COMPATIBILITY.........................................................................................
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CHAPTER 4 MEMORY MANAGEMENT SYSTEM.............................................
4.1 TRANSLATION LOOKASIDE BUFFER (TLB) ......................................................
4.1.1 Hits and Misses..................................................................................................................
4.1.2 Multiple Hit..........................................................................................................................
4.2 ADDRESS SPACES..............................................................................................
4.2.1 Virtual Address Space........................................................................................................
4.2.2 Physical Address Space.....................................................................................................
4.2.3 Virtual-to-Physical Address Translation .............................................................................
4.2.4 32-bit Mode Address Translation .......................................................................................
4.2.5 64-bit Mode Address Translation .......................................................................................
4.2.6 Operating Modes................................................................................................................
4.3 SYSTEM CONTROL COPROCESSOR.................................................................
4.3.1 Format of a TLB Entry........................................................................................................
4.3.2 CP0 Registers....................................................................................................................
4.3.3 Virtual-to-Physical Address Translation .............................................................................
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CHAPTER 5 EXCEPTION PROCESSING.........................................................
5.1 HOW EXCEPTION PROCESSING WORKS..........................................................
5.2 PRECISION OF EXCEPTIONS..............................................................................
5.3 EXCEPTION PROCESSING REGISTERS.............................................................
5.3.1 Context Register (4)...........................................................................................................
5.3.2 BadVAddr Register (8).......................................................................................................
5.3.3 Count Register (9)..............................................................................................................
5.3.4 Compare Register (11).......................................................................................................
5.3.5 Status Register (12) ...........................................................................................................
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD30102 | 64-/32-BIT Microprocessor(64/32位微處理器) |
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| μPD30122 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30181 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| PD301-024-03-P-C-200 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-300 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-PI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
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