參數(shù)資料
型號: μPD30101
廠商: NEC Corp.
英文描述: 64-Bit Microprocessor(64位微處理器)
中文描述: 64位微處理器(64位微處理器)
文件頁數(shù): 45/359頁
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代理商: ΜPD30101
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CHAPTER 1 INTRODUCTION
14
"
Halfword (16 bits)
"
Byte (8 bits)
For the V
R
4100 CPU core, byte ordering within all of the larger data formats - halfword, word,
doubleword - can be configured in either big-endian or little-endian order.
However, the V
R
4101
supports the little-endian order only.
Endianness refers to the location of byte 0 within the multi-byte data structure. Figure 1-5 shows the
ordering of bytes within words and the ordering of words within doubleword structures for the little-
endian conventions.
When configured as a little-endian system, byte 0 is always the least-significant (rightmost) byte, which
is compatible with iAPX
TM
and DEC VAX
TM
conventions. Figure 1-5 shows this configuration.
Figure 1-5. Little-Endian Byte Ordering
12
12
13
14
15
0
15
16
8
23
24
7
31
8
8
9
10
11
4
4
5
6
7
0
0
1
2
3
Lower
address
Higher
address
Word
address
Bit No.
In this manual, bit 0 is always the least-significant (rightmost) bit; thus, bit designations are always little-
endian.
Figure 1-6 shows little-endian byte ordering in doublewords.
Figure 1-6. Little-Endian Data in a Doubleword
Bits in a byte
Least-significant byte
Most-significant byte
Bit No.
Bit No.
Halfword
Byte
Word
Byte No.
7 6 5 4 3 2 1 0
0
1
2
3
4
5
6
7
0
31
32
16
47
48
15
63
相關PDF資料
PDF描述
μPD30102 64-/32-BIT Microprocessor(64/32位微處理器)
μPD30121 64-Bit MIPS RISC Microprocessor(64 位RISC 微處理器)
μPD30122 64-Bit RISC Microprosessor(64位RISC微處理器)
μPD30181 64-Bit RISC Microprosessor(64位RISC微處理器)
μPD30210 64-Bit MIPS RISC Microprocessor(64位MIPS RISC 微處理器)
相關代理商/技術參數(shù)
參數(shù)描述
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PD301-024-03-PI 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC