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參數(shù)資料
| 型號： | μPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Microprocessor(64位微處理器) |
| 中文描述： | 64位微處理器（64位微處理器） |
| 文件頁數(shù)： | 20/359頁 |
| 文件大?。?/td> | 1652K |
| 代理商： | ΜPD30101 |
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- xiv -
LIST OF FIGURES (1/8)
Fig. No.
Title
Page
1-1.
1-2.
1-3.
1-4.
1-5.
1-6.
1-7.
1-8.
1-9.
1-10.
V
R
4101 Internal Block Diagram and Example of Connection to External Blocks ......................
V
R
4100 CPU Core Internal Block Diagram................................................................................
V
R
4101 CPU Registers..............................................................................................................
CPU Instruction Formats............................................................................................................
Little-Endian Byte Ordering........................................................................................................
Little-Endian Data in a Doubleword............................................................................................
Misaligned Word Accessing (Little-Endian)................................................................................
CP0 Registers............................................................................................................................
External Circuit of Clock Oscillator.............................................................................................
Examples of Oscillator with Bad Connection .............................................................................
2
10
12
12
14
14
15
16
20
21
2-1.
CPU Instruction Formats............................................................................................................
23
3-1.
3-2.
3-3.
3-4.
3-5.
3-6.
3-7.
3-8.
3-9.
3-10.
3-11.
3-12.
3-13.
3-14.
3-15.
3-16.
3-17.
Pipeline Stages..........................................................................................................................
Instruction Execution in the Pipeline..........................................................................................
Pipeline Activities.......................................................................................................................
Branch Delay..............................................................................................................................
Add Instruction Pipeline Activities..............................................................................................
JALR Instruction Pipeline Activities............................................................................................
BEQ Instruction Pipeline Activities.............................................................................................
TLT Instruction Pipeline Activities..............................................................................................
LW Instruction Pipeline Activities...............................................................................................
SW Instruction Pipeline Activities...............................................................................................
Interlocks, Exceptions, and Faults .............................................................................................
Correspondence of Pipeline Stage to Interlock and Exception Condition..................................
Exception Detection...................................................................................................................
Data Cache Miss Stall................................................................................................................
CACHE Instruction Stall.............................................................................................................
Load Data Interlock....................................................................................................................
MD Busy Interlock......................................................................................................................
35
36
36
38
39
40
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43
44
45
46
48
49
49
50
50
4-1.
4-2.
4-3.
4-4.
4-5.
Virtual-to-Physical Address Translation.....................................................................................
V
R
4101 Physical Address Space...............................................................................................
32-bit Mode Virtual Address Translation....................................................................................
64-bit Mode Virtual Address Translation....................................................................................
User Mode Address Space........................................................................................................
54
55
57
58
59
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD30102 | 64-/32-BIT Microprocessor(64/32位微處理器) |
| μPD30121 | 64-Bit MIPS RISC Microprocessor(64 位RISC 微處理器) |
| μPD30122 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30181 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30210 | 64-Bit MIPS RISC Microprocessor(64位MIPS RISC 微處理器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PD301-024-03-PC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| PD301-024-03-P-C-200 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-300 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-PI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
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