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參數(shù)資料
| 型號： | μPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Microprocessor(64位微處理器) |
| 中文描述： | 64位微處理器（64位微處理器） |
| 文件頁數(shù)： | 138/359頁 |
| 文件大小： | 1652K |
| 代理商： | ΜPD30101 |
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CHAPTER 5 EXCEPTION PROCESSING
107
5.4.8 TLB Exceptions
Three types of TLB exceptions can occur:
"
TLB Refill exception occurs when there is no TLB entry that matches a referenced address.
"
A TLB Invalid exception occurs when a TLB entry that matches a referenced virtual address is
marked as being invalid (with the V bit set to 0).
"
The TLB Modified exception occurs when a TLB entry that matches a virtual address referenced by
the store instruction is marked as being valid (with the V bit set to 1), but is not writeable.
The following three sections describe these TLB exceptions.
(1) TLB Refill exception (32-bit space mode)/XTLB Refill exception (64-bit space mode)
Cause
The TLB Refill exception occurs when there is no TLB entry to match a reference to a mapped address
space. This exception is not maskable.
Processing
There are two special exception vectors for this exception; one for references to 32-bit address spaces,
and one for references to 64-bit address spaces. The UX, SX, and KX bits of the Status register
determine whether the user, supervisor or kernel address spaces referenced are 32-bit or 64-bit
spaces. When the EXL bit of the Status is set to 0, these two special vectors are referenced. When
the EXL bit is set to 1, the common exception vector is referenced.
This exception sets the TLBL or TLBS code in the ExcCode field of the Cause register. If this exception
has been caused by an instruction reference or load operation, TLBL is set. If it has been caused by a
store operation, TLBS is set.
When this exception occurs, the BadVAddr, Context, XContext and EntryHi registers hold the virtual
address that failed address translation. The EntryHi register also contains the ASID from which the
translation fault occurred. The Random register normally contains a valid location in which to place the
replacement TLB entry. The contents of the EntryLo register are undefined.
The EPC register contains the address of the instruction that caused the exception, unless this
instruction is in a branch delay slot, in which case the EPC register contains the address of the
preceding branch instruction and the BD bit of the Cause register is set to 1.
Servicing
To service this exception, the contents of the Context or XContext register are used as a virtual address
to fetch memory words containing the physical page frame and access control bits for a pair of TLB
entries. The memory word is written into the TLB entry by using the EntryLo0, EntryLo1, or EntryHi
register.
It is possible that the physical page frame and access control bits are placed in a page where the virtual
address is not resident in the TLB. This condition is processed by allowing a TLB Refill exception in the
TLB Refill exception handler. In this case, the common exception vector is used because the EXL bit of
the Status register is set to 1.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD30102 | 64-/32-BIT Microprocessor(64/32位微處理器) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| PD301-024-03-P-C-200 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-300 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-PI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
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