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參數(shù)資料
| 型號： | μPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Microprocessor(64位微處理器) |
| 中文描述： | 64位微處理器（64位微處理器） |
| 文件頁數(shù)： | 146/359頁 |
| 文件大?。?/td> | 1652K |
| 代理商： | ΜPD30101 |
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CHAPTER 5 EXCEPTION PROCESSING
115
5.4.16 Integer Overflow Exception
Cause
An Integer Overflow exception occurs when an ADD, ADDI, SUB, DADD, DADDI or DSUB instruction
results in a 2’s complement overflow. This exception is not maskable.
Processing
The common exception vector is used for this exception, and the Ov code in the ExcCode field of the
Cause register is set.
The EPC register contains the address of the instruction that caused the exception unless the
instruction is in a branch delay slot, in which case the EPC register contains the address of the
preceding branch instruction and the BD bit of the Cause register is set to 1.
Servicing
At the time of the exception, the kernel reports the UNIX SIGFPE/FPE_INTOVF_TRAP (floating-point
exception/integer overflow) signal to the current process, but the exception is usually fatal.
5.4.17 Watch Exception
Cause
A Watch exception occurs when a load or store instruction references the physical address specified in
the WatchLo/WatchHi register. The WatchLo/WatchHi register specify whether a load or store or both
could have initiated this exception.
"
When the R bit of the WatchLo register is set to 1: Load instruction
"
When the W bit of the WatchLo register is set to 1: Store instruction
"
When both the R bit and W bit of the WatchLo register are set to 1: Load instruction or store
instruction
The CACHE instruction never causes a Watch exception.
The Watch exception is postponed if the EXL bit is set to 1 in the Status register, and Watch is only
maskable by setting the EXL bit to 1 in the Status register.
Processing
The common exception vector is used for this exception, and the WATCH code in the ExcCode field of
the Cause register is set.
The EPC register contains the address of the load or store instruction that caused the exception unless
it is in a branch delay slot, in which case the EPC register contains the address of the preceding branch
instruction and the BD bit of the Cause register is set to 1.
Servicing
The Watch exception is a debugging aid; typically the exception handler transfers control to a debugger,
allowing the user to examine the situation. To continue, the Watch exception must be disabled to
execute the faulting instruction. The Watch exception must then be reenabled. The faulting instruction
can be executed either by the debugger or by setting breakpoints.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD30102 | 64-/32-BIT Microprocessor(64/32位微處理器) |
| μPD30121 | 64-Bit MIPS RISC Microprocessor(64 位RISC 微處理器) |
| μPD30122 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30181 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30210 | 64-Bit MIPS RISC Microprocessor(64位MIPS RISC 微處理器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PD301-024-03-PC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| PD301-024-03-P-C-200 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-300 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-PI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
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