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參數(shù)資料
| 型號(hào)： | μPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Microprocessor(64位微處理器) |
| 中文描述： | 64位微處理器（64位微處理器） |
| 文件頁數(shù)： | 9/359頁 |
| 文件大?。?/td> | 1652K |
| 代理商： | ΜPD30101 |
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- iii -
TABLE OF CONTENTS
CHAPTER 1 INTRODUCTION ..........................................................................
1.1 CHARACTERISTICS.............................................................................................
1.2 ORDERING INFORMATION..................................................................................
1.3 64-BIT ARCHITECTURE.......................................................................................
1.4 V
R
4101 PROCESSOR...........................................................................................
1.4.1 Internal Structure................................................................................................................
1.4.2 I/O registers........................................................................................................................
1.5 V
R
4100 CPU CORE ..............................................................................................
1.5.1 Internal Structure................................................................................................................
1.5.2 CPU Registers....................................................................................................................
1.5.3 CPU Instruction Set Overview............................................................................................
1.5.4 Data Formats and Addressing............................................................................................
1.5.5 Coprocessors (CP0-CP3)...................................................................................................
1.5.6 Floating-Point Unit (FPU)...................................................................................................
1.5.7 Cache.................................................................................................................................
1.6 MEMORY MANAGEMENT SYSTEM (MMU)..........................................................
1.6.1 Translation Lookaside Buffer (TLB)....................................................................................
1.6.2 Operating Modes................................................................................................................
1.7 INSTRUCTION PIPELINE.....................................................................................
1.8 CLOCK INTERFACE.............................................................................................
1
1
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18
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19
19
CHAPTER 2 CPU INSTRUCTION SET SUMMARY...........................................
2.1 CPU INSTRUCTION FORMATS............................................................................
2.1.1 Support of the MIPS ISA....................................................................................................
2.2 INSTRUCTION CLASSES.....................................................................................
2.2.1 Load and Store Instructions ...............................................................................................
2.2.2 Computational Instructions.................................................................................................
2.2.3 Jump and Branch Instructions............................................................................................
2.2.4 Special Instructions............................................................................................................
2.2.5 System Control Coprocessor (CP0) Instructions................................................................
2.3 V
R
4101 CPU INSTRUCTION SET.........................................................................
23
23
24
24
24
26
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27
28
28
CHAPTER 3 V
R
4101 PIPELINE ........................................................................
3.1 PIPELINE STAGES...............................................................................................
3.1.1 Pipeline Activities ...............................................................................................................
3.2 BRANCH DELAY...................................................................................................
35
35
36
38
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD30102 | 64-/32-BIT Microprocessor(64/32位微處理器) |
| μPD30121 | 64-Bit MIPS RISC Microprocessor(64 位RISC 微處理器) |
| μPD30122 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30181 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30210 | 64-Bit MIPS RISC Microprocessor(64位MIPS RISC 微處理器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PD301-024-03-PC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| PD301-024-03-P-C-200 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-300 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-PI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
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