19-4750; Rev 1; 07/11 82 of 194 Register Name Addr (hex) Description STATS_ALIGN_ERRORS 0D9C Alignment Errors ST" />
參數(shù)資料
型號： DS34S132GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 176/194頁
文件大小： 0K
描述： IC TDM OVER PACKET 676-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 40
功能： TDM-over-Packet（TDMoP）
接口： TDMoP
電路數(shù)： 1
電源電壓： 1.8V, 3.3V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-PBGA（27x27）
包裝： 管件
其它名稱： 90-34S13+2N0
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
82 of 194
Register Name
Addr (hex)
Description
STATS_ALIGN_ERRORS
0D9C
Alignment Errors
STATS_RX_RES_ERR
0DA0
Receive Resource Errors
STATS_RX_ORUN
0DA4
Receive Overruns
IP_HDR_CHK
0DA8
IP Header Checksum Errors
TCP_CHK
0DAC
TCP Checksum Errors
UDP_CHK
0DB0
UDP Checksum Errors
RSVD
0E00
Reserved
REG_TOP
0E3C
Reserved
Port n TXP SW CAS Registers (TXSCn.; n = 0 to 31)
CR1
1000 + n*0010 Port n Configuration Register 1
CR2
1004 + n*0010 Port n Configuration Register 2
CR3
1008 + n*0010 Port n Configuration Register 3
CR4
100C + n*0010 Port n Configuration Register 4
Port n Xmt (RXP) SW CAS Registers (RXSCn. ; n = 0 to 31)
CR1
1200 + n*0010 Port n Configuration Register 1
CR2
1204 + n*0010 Port n Configuration Register 2
CR3
1208 + n*0010 Port n Configuration Register 3
CR4
120C + n*0010 Port n Configuration Register 4
Port n Transmit Configuration Registers (Pn.; n = 0 to 31)
PTCR1
2000 + n*0080 Port n Transmit Configuration Register 1
PTCR2
2004 + n*0080 Port n Transmit Configuration Register 2
PTCR3
2008 + n*0080 Port n Transmit Configuration Register 3
Port n Transmit Status Registers (Pn.; n = 0 to 31)
PTSR1
2020 + n*0080 Port n Transmit Status Register 1
PTSR2
2024 + n*0080 Port n Transmit Status Register 2
PTSR3
2028 + n*0080 Port n Transmit Status Register 3
PTSR4
202C + n*0080 Port n Transmit Status Register 4
Port n Transmit Status Latch Registers (Pn.; n = 0 to 31)
PTSRL
2030 + n*0080 Port n Transmit Status Register Latch
Port n Transmit Status Interrupt Enable Registers (Pn.; n = 0 to 31)
PTSRIE
2038 + n*0080 Port n Transmit Status Register Interrupt Enable
Port n Receive Configuration Registers (Pn.; n = 0 to 31)
PRCR1
2040 + n*0080 Port n Receive Configuration Register 1
PRCR2
2044 + n*0080 Port n Receive Configuration Register 2
PRCR3
2048 + n*0080 Port n Receive Configuration Register 3
PRCR4
204C + n*0080 Port n Receive Configuration Register 4
PRCR5
2050 + n*0080 Port n Receive Configuration Register 5
Port n Receive Status Registers (Pn.; n = 0 to 31)
PRSR1
2060 + n*0080 Port n Receive Status Register 1
PRSR2
2064 + n*0080 Port n Receive Status Register 2
PRSR3
2068 + n*0080 Port n Receive Status Register 3
PRSR4
206C + n*0080 Port n Receive Status Register 4
Port n Receive Status Latch Registers (Pn.; n = 0 to 31)
PRSRL
2070 + n*0080 Port n Receive Status Register Latch
Port n Receive Status Interrupt Enable Registers (Pn.; n = 0 to 31)
PRSRIE
2078 + n*0080 Port n Receive Status Register Interrupt Enable
Time Slot Assignment Registers (TSAn.m.; port “n” = 0 to 31 and Timeslot “m” = 0 to 31)
CR
3000 + m*0004 Configuration Register
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PDF描述
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