19-4750; Rev 1; 07/11 133 of 194 M. Field Name Addr (A:) Bit [x:y] Type Description MSK_IRQ_RX_USED [2] ros-_-_ " />
參數(shù)資料
型號： DS34S132GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 39/194頁
文件大?。?/td> 0K
描述： IC TDM OVER PACKET 676-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 40
功能： TDM-over-Packet（TDMoP）
接口： TDMoP
電路數(shù)： 1
電源電壓： 1.8V, 3.3V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-PBGA（27x27）
包裝： 管件
其它名稱： 90-34S13+2N0
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
133 of 194
M. Field Name
Addr (A:)
Bit [x:y] Type
Description
MSK_IRQ_RX_USED
[2] ros-_-_
Reserved.
MSK_IRQ_RX_DONE
[1] ros-_-_
Reserved.
MSK_IRQ_MAN_D
ONE
[0] ros-_-_
Mask PHY Management Operation Complete. A read of this register
returns the value of the management done interrupt mask. 0: Interrupt is
enabled 1: Interrupt is disabled A write to this register directly affects the
state of the corresponding bit in the interrupt status register, causing an
interrupt to be generated if a 1 is written.
PHY_MAN.
A:0C34h
Phy Maintenance Register. Default: 0x00.00.00.00
PHY_SET3
[31] rwc-_-_
Reserved.
PHY_CL22
[30] rwc-_-_
Reserved. This must be programmed to “1”.
PHY_SET2
[29:28] rwc-_-_
Phy Set 2 selects the MDIO Operation: 2 = Read; 1 = Write.
PHY_ADDR
[27:23] rwc-_-_
Phy Address selects the MDIO Phy address.
PHY_REG_ADDR
[22:18] rwc-_-_
Phy Register Address selects the MDIO Register address.
PHY_SET1
[17:16] rwc-_-_
Reserved. This must be programmed to “2”.
PHY_DATA_WR
[15:0] rwc-_-_
Phy Data to be Written provides the Write data sent to the Phy or the
Read data received from the Phy according to the PHY_SET2 operation.
RX_PAUSE_TIME. A:0C38h
Received Pause Quantum Register. Default: 0x00.00.00.00
RSVD
[31:16]
Reserved.
RX_PAUSE_Q
[15:0] ros-_-_
Reserved.
TX_PAUSE_QUAN
T.
A:0C3Ch
Transmit Pause Quantum Register. Default: 00.00.FF.FFh
RSVD
[31:16]
Reserved.
TX_PAUSE_Q
[15:0] rwc-_-_
Reserved.
HASH_BOT.
A:0C80h
Hash Register Bottom. Default: 0x00.00.00.00
HASH_BOT
[31:0] rwc-_-_
Reserved.
HASH_TOP.
A:0C84h
Hash Register Top. Default: 0x00.00.00.00
HASH_TOP
[31:0] rwc-_-_
Reserved.
LADDR1_BOT.
A:0C88h
Specific Address 1 Bottom. Default: 0x00.00.00.00
SPEC_ADD1_BOT
[31:0] rwc-_-_
Reserved.
LADDR1_TOP.
A:0C8Ch
Specific Address 1 Top. Default: 0x00.00.00.00
RSVD
[31:16]
Reserved.
SPEC_ADD1_TOP
[15:0] rwc-_-_
Reserved.
LADDR2_BOT.
A:0C90h
Specific Address 2 Bottom. Default: 0x00.00.00.00
SPEC_ADD2_BOT
[31:0] rwc-_-_
Reserved.
LADDR2_TOP.
A:0C94h
Specific Address 2 Top. Default: 0x00.00.00.00
RSVD
[31:16]
Reserved.
SPEC_ADD2_TOP
[15:0] rwc-_-_
Reserved.
LADDR3_BOT.
A:0C98h
Specific Address 3 Bottom. Default: 0x00.00.00.00
SPEC_ADD3_BOT
[31:0] rwc-_-_
Reserved.
LADDR3_TOP.
A:0C9Ch
Specific Address 3 Top. Default: 0x00.00.00.00
RSVD
[31:16]
Reserved.
SPEC_ADD3_TOP
[15:0] rwc-_-_
Reserved.
LADDR4_BOT.
A:0CA0h
Specific Address 4 Bottom. Default: 0x00.00.00.00
SPEC_ADD4_BOT
[31:0] rwc-_-_
Reserved.
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PDF描述
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