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參數(shù)資料
| 型號(hào)： | SC1100UFH-233 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | Geode⑩ Information Appliance On a Chip |
| 中文描述： | Geode⑩信息家電在一個(gè)芯片 |
| 文件頁(yè)數(shù)： | 217/348頁(yè) |
| 文件大?。?/td> | 2063K |
| 代理商： | SC1100UFH-233 |
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Revision 1.1
217
www.national.com
G
Core Logic Module
(Continued)
Offset 08h-09h
Notes:
PM1A_STS — PM1A Top Level PME/SCI Status Register (R/W)
1. This is the top level of PME/SCI status reporting for these events. There is no second level.
Reset Value: 0000h
2.
If SCI generation is not desired, the status bits are still set by the described conditions and can be used for monitoring pur-
poses.
15
WAK_STS (Wakeup Status).
Indicates whether or not an SCI was caused by the occurrence of an enabled wakeup event.
0: No.
1: Yes.
This bit is set when the system is in any Sleep state and an enabled wakeup event occurs (wakeup events are configured at
F1BAR1+I/O Offset 0Ah and 12h). After this bit is set, the system transitions to a Working state.
SCI generation is always enabled.
Write 1 to clear.
Reserved.
Must be set to 0.
PWRBTNOR_STS (Power Button Override Status).
Indicates whether or not an SCI was caused by the power button
being active for greater than 4 seconds.
0: No.
1: Yes.
SCI generation is always enabled.
Write 1 to clear.
RTC_STS (Real-Time Clock Status).
Indicates if a Power Management Event (PME) was caused by the RTC generating
an alarm (RTC IRQ signal is asserted).
0: No.
1: Yes.
For the PME to generate an SCI, set F1BAR1+I/O Offset 0Ah[10] to 1 and F1BAR1+I/O Offset 0Ch[0] to 1. (See Note 2 in
the general description of this register.)
Write 1 to clear.
Reserved.
Must be set to 0.
PWRBTN_STS (Power Button Status).
Indicates if PME was caused by the PWRBTN# (ball AF15) going low while the
system is in a Working state.
0: No.
1: Yes.
For the PME to generate an SCI, set F1BAR1+I/O Offset 0Ah[8] = 1 and F1BAR1+I/O Offset 0Ch[0] = 1. (See Note 2 in the
general description of this register.)
In a Sleep state or the Soft-Off state, a wakeup event is generated when the power button is pressed (regardless of the
PWRBTN_EN bit, F1BAR1+I/O Offset 0Ah[8], setting).
Write 1 to clear.
Reserved.
Must be set to 0.
GBL_STS (Global Lock Status).
Indicates if PME was caused by the BIOS releasing control of the global lock.
0: No.
1: Yes.
This bit is used by the BIOS to generate an SCI. BIOS writes the BIOS_RLS bit (F1BAR1+I/O Offset 0Fh[1]) which in turns
sets the GBL_STS bit and raises a PME.
For the PME to generate an SCI, set F1BAR1+I/O Offset 0Ah[5] to 1 and F1BAR1+I/O Offset 0Ch[0] to 1. (See Note 2 in the
general description of this register.)
Write 1 to clear.
BM_STS (Bus Master Status).
Indicates if PME was caused by a system bus master requesting the system bus.
0: No.
1: Yes.
For the PME to generate an SCI, set F1BAR1+I/O Offset 0Ch[1] = 1 and F1BAR1+I/O Offset 0Ch[0] = 1. (See Note 2 in the
general description of this register.)
Write 1 to clear.
Reserved.
Must be set to 0.
14:12
11
10
9
8
7:6
5
4
3:1
Table 5-34. F1BAR1+I/O Offset: ACPI Support Registers (Continued)
Bit
Description
相關(guān)PDF資料 |
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