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參數(shù)資料
| 型號： | SC1100UFH-233 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | Geode⑩ Information Appliance On a Chip |
| 中文描述： | Geode⑩信息家電在一個芯片 |
| 文件頁數(shù)： | 299/348頁 |
| 文件大小： | 2063K |
| 代理商： | SC1100UFH-233 |
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Revision 1.1
299
www.national.com
G
Electrical Specifications
(Continued)
Figure 7-11. V/I Curves for PCI Output Signals
Pull-Up
Pull-Down
Test Point
V
IO
0.9
V
IO
DC
Drive Point
AC
Drive Point
0.3
V
IO
0.6
V
IO
0.1
AC
Drive Point
DC
Drive Point
Test Point
V
IO
Equation A
for V
IO
>V
OUT
>0.7V
IO
I
OL
= (256/V
IO
)*V
OUT
*(V
IO
-V
OUT
)
for 0V<V
OUT
<0.18V
IO
Volts
Volts
I
OL
mA
I
OH
mA
64V
IO
16V
IO
1.5
-12V
IO
-48V
IO
-0.5
I
OH
= (98.0/V
IO
)*(V
OUT
-V
IO
)*(V
OUT
+0.4V
IO
)
Equation B
Output Voltage
Output Voltage
0.5V
IO
Table 7-13. PCI Clock Parameters
Symbol
Parameter
Min
Max
Unit
Comments
t
CYC
PCICLK Cycle time
1
30
ns
t
HIGH
PCICLK High time
2
11
ns
t
LOW
PCICLK Low time
2
11
ns
PCICLK
sr
PCICLK Slew Rate
3
1
4
V/ns
PCIRST
sr
PCIRST# Slew Rate
4
50
-
mV/ns
1.
Clock frequency is between nominal DC and 33 MHz. Device operational parameters at frequencies under 16 MHz are
not 100% tested. The clock can only be stopped in a low state.
Guaranteed by characterization.
Slew rate must be met across the minimum peak-to-peak portion of the clock waveform (see Figure 7-12).
The minimum PCIRST# slew rate applies only to the rising (deassertion) edge of the reset signal. See Figure 7-16
for PCIRST# timing.
2.
3.
4.
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