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參數(shù)資料
| 型號： | TMPR28051 |
| 英文描述： | TMPR28051 STS-1/AU-3 (STM-0) Mapper Device Advisory for Version 5 of the Device |
| 中文描述： | TMPR28051 STS-1/AU-3（的STM - 0）映射為版本的設(shè)備5設(shè)備咨詢 |
| 文件頁數(shù)： | 83/90頁 |
| 文件大小： | 1090K |
| 代理商： | TMPR28051 |
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Data Sheet
August 1999
TMPR28051 STS-1/AU-3 (STM-0) Mapper
69
Lucent Technologies Inc.
Timing Characteristics
(continued)
Operational Timing
(continued)
The output clock specifications are shown in Table 40.
*
The duty-cycle distortion added to the TSTS1CLKOUT signal is
≤
2% worst case when measured from 1.5 V in to 1.5 V out with a 2 ns rise
time input.
Table 41 lists the propagation delay (t
PD
) specifications for the output signals. The digital system interface timing is
shown in Figure 11, page 68.
* Propagation delay skew, t
PLH
—t
PHL,
is ±200 ps.
Notes:
↑
represents a low-to-high transition.
↓
represents a high-to-low transition.
Table 40. Output Clock Specifications
Signal Name
Frequency
Test
Conditions
Rise Time
Fall Time
Unit
t
R
t
F
Min
Max
Min
Max
TCLK[1:28]
(DS1 Mode)
TCLK[1:28]
(E1 Mode)
TSTS1CLKOUT
*
1.544 MHz ± 5%
C
L
= 50 pF
—
30
—
30
ns
2.048 MHz ± 5%
C
L
= 50 pF
—
30
—
30
ns
51.84 MHz ± 5%
19.44 MHz ± 5%
6.48 MHz ± 5%
C
L
= 15 pF
C
L
= 15 pF
C
L
= 15 pF
—
—
—
3
3
3
—
—
—
3
3
3
ns
ns
ns
Table 41. Output Timing Specifications
Output Name
Reference CLK
Test
Conditions
Propagation Delay
*
Unit
t
PD
Min
Max
Transmit Signals
C
L
= 25 pF
C
L
= 15 pF
C
L
= 15 pF
C
L
= 15 pF
JTAG Signal
C
L
= 50 pF
TDATA[28:1]
TSTS1DATA[7:0]
TSTS1PAR
TSTS1DATA7
TCLK[1:28]
↑↓
TSTS1CLKIN
↑
TSTS1CLKIN
↑
TSTS1CLKIN
↑
40
2
2
0
190
12
12
3.5
ns
ns
ns
ns
TDO
TCK
↓
1.5
17
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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