參數資料
型號： 21440
廠商： Intel Corp.
英文描述： Multiport 10/100Mb/s Ethernet Controller(多端口10/100Mb/s 以太網控制器)
中文描述： 多端口10/100Mb/s以太網控制器（多端口支持10/100Mbps以太網控制器）
文件頁數： 22/92頁
文件大?。?/td> 1352K
代理商： 21440
Register Descriptions
3-2
21440 Multiport 10/100Mb/s Ethernet Controller
3.2
CSR Register
This section describes the 21440 CSR register mapping.
3.2.1
Register Mapping
Table 3-1
lists each CSR register name, mnemonic, address offset, and the section that describes
the register.
Table 3-1. CSR Register Mapping
Register Description
Mnemonic
I/O Address
Offset
Section
Base Registers
3.2.2
Chip interrupt summary register
1
1.
These registers are valid in Port 0 only.
CHIP_INT
00H
3.2.2.1
Interrupt status register
INT_STT
01H
3.2.2.2
Interrupt enable register
INT_EN
02H
3.2.2.3
Transmit status register
TXMT_STT
03H
3.2.2.4
Receive status register
RECV_STT
04H
3.2.2.5
Port control register
Device identification number register
1
Revision identification number register
1
PORT_CTR
05H
3.2.2.6
DEV_ID
06H
3.2.2.7
REV_ID
07H
3.2.2.8
Serial command register
SER_COM
08H
3.2.2.9
Configuration Registers
3.2.3
FIFO threshold register
FFO_TSHD
11H
3.2.3.1
FIFO bus mode register
FFO_BUS
12H
3.2.3.2
Transmit parameters register
TX_PARAM
13H
3.2.3.3
Transmit error mode register
TX_ERR_MOD
14H
3.2.3.4
Transmit packet sending threshold and
backoff limit register
TX_TSHD_BOFF
15H
3.2.3.5
Receive parameters register
RX_PARAM
16H
3.2.3.6
Receive filtering mode register
RX_FILT_MOD
17H
3.2.3.7
Transmit flow-control pause time register
PAUSE_TIME
18H
–
19H
3.2.3.8
Maximum packet size register
PKT_MAX_SIZE
1AH
–
1BH
3.2.3.9
InterPacket gap register
IPG
32H
–
33H
3.2.3.10
Serial Registers
3.2.4
Serial mode register
SER_MOD
21H
3.2.4.1
Link status register
LNK_STT
22H
3.2.4.2
Physical address register
PHY_ADD
28H
–
2DH
3.2.4.3
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