參數資料
型號： TMXF281553BAL-3C-DB
元件分類： 通信、網絡模塊及開發(fā)工具
英文描述： Telecomm/Datacomm
中文描述： 電信/數據通信
文件頁數： 172/784頁
文件大小： 10831K
代理商： TMXF281553BAL-3C-DB
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
172
Agere Systems Inc.
10 VT/TU Mapper Registers
(continued)
Table 215. VT_TSIG_CTL[1—28], Transmit Signaling Control Per Channel (R/W)
Table 216. VT_J2BYTE_INS_R[1—28][1—16], J2 Insert Values Per Channel (R/W)
Address
Bit
Name
Function
Reset
Default
000000
0x1
0x2014C
—
0x20167
15:11
10
RSVD
Reserved.
Frame Bit Use Control.
Logic 1 provisions use
of the F bit in the outgoing VT/TU. Otherwise,
the F bit is forced to the value of bit
SMPR_OH_DEFLT (
Table 77 on page 70
) in
the microprocessor interface on the outgoing
VT/TU.
Phase Bit Use Control.
Logic 1 provisions use
of the P bits in the outgoing VT/TU. Otherwise,
the P bits are forced to the value of bit
SMPR_OH_DEFLT in the microprocessor inter-
face on the outgoing VT/TU.
Signaling Bit Use Control.
Logic 1 provisions
use of the S bits in the outgoing VT/TU. Other-
wise, the S bits are forced to the value of bit
SMPR_OH_DEFLT in the microprocessor inter-
face on the outgoing VT/TU.
Reserved.
Transmit Input Channel Selection.
These bits
are programmed with the same value as the
cross connect for each individual channel. The
bits are only used in byte-synchronous mode
and can be set to 0xXX for all other modes. If an
invalid value is programmed, UNEQ-V will be
transmitted in the specified channel. Invalid
decimal values are 0, 29, 30, and 31.
VT_USE_FBIT[1—28]
9
VT_USE_PBIT[1—28]
0x1
8
VT_USE_SBIT[1—28]
0x1
7:5
4:0
RSVD
000
0x00
VT_TXSIG_CH_SEL[1—28][4:0]
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x20168
—
0x20327
15:8
7:0
RSVD
Reserved.
J2 Software Overwrite Values.
These values are written
into the outgoing J2 byte when VT_J2_INS[1—28][1:0] = 01
(
Table 212 on page 171
).
VT_J2BYTE_
INS[1—28][1—16][7:0]
Table 217. VT_RCTL[1—28], Receive Control Per Channel (R/W)
Address
Bit
Name
Function
Reset
Default
0x0
0x20328
—
0x20343
15
VT_SF_ESF[1—28]
DS1 Frame Type for Byte-Synchronous
Mode.
Logic 1 provisions an SF frame format.
Otherwise, an ESF frame format is provisioned.
F-Bit Provisioning Control.
See
Table 568 on
page 446
.
P-Bit Provisioning Control.
See
Table 568 on
page 446
.
14
VT_WR_FBIT[1—28]
0x0
13
VT_SYNC_PBIT[1—28]
0x0
相關PDF資料
PDF描述
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
相關代理商/技術參數
參數描述
TMXF336251BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag 制造商:LSI 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag
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TMXM-0-49 制造商:Brady Corporation 功能描述:
TMXM-11 制造商:Brady Corporation 功能描述:
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