參數(shù)資料
型號(hào)： TMXF281553BAL-3C-DB
元件分類： 通信、網(wǎng)絡(luò)模塊及開(kāi)發(fā)工具
英文描述： Telecomm/Datacomm
中文描述： 電信/數(shù)據(jù)通信
文件頁(yè)數(shù)： 428/784頁(yè)
文件大小： 10831K
代理商： TMXF281553BAL-3C-DB
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
428
Agere Systems Inc.
18 SPE Mapper Functional Description
(continued)
18.15.7 Path RDI (RDI-P) Insert
When transmit RDI software insert control bit SPE_TPRDIINS = 1 (
Table 165 on page 148
), data from
SPE_TG1DINS[3:1] (
Table 167 on page 149
) is written into the G1[3:1] output bits. When SPE_TPRDIINS = 0,
hardware insert is enabled for RDI-P insertion. Each defect contribution to the RDI-P outgoing code
can be inhib-
ited
.
There are two modes supported for path RDI Insertion. One mode conforms to the earlier 1-bit version of the
standard. The other mode, enhanced RDI-P mode, uses a 3-bit RDI-P code and conforms to the current version of
the standard. When the mode selection bit SPE_TPRDI_MODE = 0 (
Table 165 on page 148
), the SPE mapper
sends a 3-bit code that conforms to the earlier 1-bit version of the standards. When SPE_TPRDI_MODE = 1, the
SPE mapper sends a 3-bit code conforming to the current enhanced path RDI encoding. Note that for nonen-
hanced RDI-P mode, the relevant defects are AIS-P and LOP-P. For enhanced RDI-P mode, the relevant defects
are AIS-P, LOP-P, TIM-P, PLM-P, UNEQ-P, and TIM-P.
When a failure condition exists that will cause RDI-P to be generated via hardware, the generation of RDI-P must
last for at least 20 frames before clearing, even if the original failure cause has cleared in less than 20 frames.
The following table describes the encoding of the path-RDI defects.
Table 560. RDI-P Defects for Enhanced RDI-P Mode
18.15.8 F2 Byte Insert
When control bit SPE_TF2INS = 1 (
Table 164 on page 146
), insert the value in SPE_TF2DINS[7:0] (
Table 167 on
page 149
) in the outgoing F2 byte; otherwise, insert the associated POAC value when bit SPE_TPOAC_F2 = 1
(
Table 164
), or insert the default value determined by the microprocessor bit SMPR_OH_DEFLT (
Table 77 on
page 70
) when SPE_TPOAC_F2 = 0.
18.15.9 H4 Insert Control
When control bit SPE_TH4INS = 1 (v), insert the value in SPE_TH4DINS[7:0] (
Table 167 on page 149
) in the out-
going H4 byte; otherwise, insert the associated POAC value when bit SPE_TPOAC_H4 = 1 (
Table 164 on
page 146
), or insert the default value determined by the microprocessor bit SMPR_OH_DEFLT when
SPE_TPOAC_H4 = 0.
18.15.10 F3 Byte Insert
When control bit SPE_TF3INS = 1 (
Table 164 on page 146
), insert the value in SPE_TF3DINS[7:0] (
Table 167 on
page 149
) in the outgoing F3 byte; otherwise, insert the associated POAC value when bit SPE_TPOAC_F3 = 1
(
Table 164
), or insert the default value determined by the microprocessor bit SMPR_OH_DEFLT (
Table 77 on
page 70
) when SPE_TPOAC_F3 = 0.
G1
Bit 2
0
0
1
1
0
0
1
1
Triggers
Bit 3
0
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1
No defects (nonenhanced RDI-P mode)
No defects (enhanced RDI-P mode)
LCD-P, PLM-P (LCD-P not supported in Supermapper)
No defects (nonenhanced RDI-P mode)
AIS-P, LOP-P (nonenhanced RDI-P mode)
AIS-P, LOP-P (enhanced RDI-P mode)
TIM-P, UNEQ-P (enhanced RDI-P mode)
AIS-P, LOP-P (nonenhanced RDI-P mode)
相關(guān)PDF資料
PDF描述
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TMXF336251BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag 制造商:LSI 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag
TMXF84622 制造商:AGERE 制造商全稱:AGERE 功能描述:TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
TMXF846221BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS2/DS1/DS0/E1 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 700-Pin BGA Bag
TMXM-0-49 制造商:Brady Corporation 功能描述:
TMXM-11 制造商:Brady Corporation 功能描述:
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