參數(shù)資料
型號(hào)： TMXF281553BAL-3C-DB
元件分類： 通信、網(wǎng)絡(luò)模塊及開發(fā)工具
英文描述： Telecomm/Datacomm
中文描述： 電信/數(shù)據(jù)通信
文件頁數(shù)： 562/784頁
文件大?。?/td> 10831K
代理商： TMXF281553BAL-3C-DB
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
562
Agere Systems Inc.
22 Cross Connect (XC) Block Functional Description
(continued)
22.6.6 Framer System Interface
The framer system interface FRM_TS/FRM_RS consists of bundles of data, clock, and/or sync/miscellany, that
may only be connected to the device external I/O pins. The system interface operates as the parallel system bus
(PSB), concentration highway (CHI), or network serial multiplexed interface (NSMI). Note that not all pins are used
in these configurations. The user should exercise caution in mixing the usage of the external pins between system
interface TS/RS usage and any other use.
Two register bits, XC_SI_CHI and XC_SYNC_FOR_DATA (
Table 461 on page 327
), and a group of seven 2-bit
parameters XC_CHI_MODE[1—7][1:0] (
Table 462 on page 327
) are used to assist with the configuration of the
system interface.
22.6.7 Framer System Interface
—
PSB
The framer system interface is configured for the parallel system bus as depicted in
Figure 87
. Program bit
XC_SI_CHI = 1 to select the PSB mode, and bit XC_SYNC_FOR_DATA = 1 to allow the connecting of transmit sys-
tem data outputs to the LINETXSYNC[1—29] pins. The programming of the XC_CHI_MODE[1—7][1:0] bits is not
required.
The PSB configuration is completed by programming appropriate source IDs into the XC_RS_D[1—28][7:0]
(
Table 469 on page 329
) and XC_SYNC[1—29] (
Table 477 on page 332
) bytes of the XC_FRS_SRC[1—14]
(
Table 469
) and XC_PINS_SRC[1—14] (
Table 477 on page 332
) XC1 crosspoint configuration registers.
5-9185(F)r.2
Figure 87. Framer System Interface—Parallel System Bus (PSB)
22.6.8 Framer System Interface
—
CHI
The framer system interface is configured for CHI operation as shown in
Figure 88
. Program bit XC_SI_CHI = 0
(
Table 461 on page 327
) to select the CHI mode, and bit XC_SYNC_FOR_DATA = 1 (
Table 461
) to allow the con-
necting of transmit system data outputs to the LINETXSYNC[1—29] pins.
EXTERNAL I/O
AS PSB
XC
FRM_TS/FRM_RS
LINETXSYNC[4—1]
LINETXSYNC29
LINERXSYNC[16—1]
LINERXSYNC29
LINERXDATA29
LINERXCLK29
LINETXCLK29
TS_D[16—1]
RS_D[16—1]
TS_GCLK
TS_GFS
RS_GCLK
RS_GFS
RS_GTCLK
LINETXSYNC[16—13]
XC_RS_D[1—28][7:0]
XC_SI_CHI = 1
XC_CHI_MODE[1—7][1:0] = 00
XC_SYNC_FOR_DATA = 1
XC_SYNC[1—29][7:0]
XC1
FRAMER SYSTEM INTERFACE
Σ
Σ
相關(guān)PDF資料
PDF描述
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
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參數(shù)描述
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