參數資料
型號： TMXF281553BAL-3C-DB
元件分類： 通信、網絡模塊及開發(fā)工具
英文描述： Telecomm/Datacomm
中文描述： 電信/數據通信
文件頁數： 505/784頁
文件大小： 10831K
代理商： TMXF281553BAL-3C-DB
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
505
Agere Systems Inc.
21 28-Channel Framer Block Functional Description
(continued)
21.14.2 Signaling State Mode Selection
The signaling state mode is selected by programming bits 5 and 6 in FRM_TSLR0—FRM_TSLR31 (
Table 384 on
page 273
)
for each link. The bit definition for each of those 32 registers is illustrated below.
Table 594. Transmit Signaling Link Registers 0—31 Bit Description
The signaling state mode definitions are illustrated in the table below.
Table 595. Transmit Signaling Link Registers 0—31 G-Bit and F-Bit Description
The signaling state mode for DS1 type links should be set to match the function of each time slot. The signaling
state mode does not apply to CEPT type links, and the value must be kept in the reset state which is 00. The sig-
naling state mode for CMI type links must be set to 11.
The sixteen state mode, which is the state mode selected out of reset, can be used on SF-type DS1 links in order
to detect a toggle code. In this case, signaling will be collected over two superframes and stored as a 4-bit code.
When programming the state mode for each time slot, the host can also program the DCBA bits in the same regis-
ter. Doing this will determine the default code forwarded to the transmit line or the transmit VT mapper interface
before the first valid signaling code has been extracted from the receive line or receive system interface.
Each of the links and time slots is completely independent from one another with respect to the signaling state
mode selection. Any combination is acceptable.
21.14.3 Signaling Source Selection
There are three sources for signaling in the transmit path.
I
Transmit signaling link registers 0—31 (host programmed)
I
Receive system interface
I
Receive line interface
The signaling source is selected by programming FRM_T_SIGSRC[1:0] in FRM_TSLR32 (
Table 385 on
page 274
), bits [1:0]. If the source of signaling is the host, then the Transmit Signaling Link Registers 0—31 must
be programmed with valid signaling.
Table 596 on page 506
shows the organization of signaling data in those reg-
isters for the different types of links.
Bit 6
G
Bit 5
F
Bit 4
—
Bit 3
D
Bit 2
C
Bit 1
B
Bit 0
A
G and F
00
01
10
11
Signaling State Mode Selected
16 state (reset state)
4 state
No signaling
2 state
相關PDF資料
PDF描述
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
相關代理商/技術參數
參數描述
TMXF336251BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag 制造商:LSI 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag
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TMXM-11 制造商:Brady Corporation 功能描述:
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