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參數(shù)資料
| 型號： | LXT386 |
| 廠商： | Intel Corp. |
| 英文描述： | QUAD T1/E1/J1 Transceiver |
| 中文描述： | 四T1/E1/J1收發(fā)器 |
| 文件頁數(shù)： | 59/78頁 |
| 文件大?。?/td> | 500K |
| 代理商： | LXT386 |
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QUAD T1/E1/J1 Transceiver
—
LXT386
Datasheet
59
Table 42. Analog Test Port Characteristics
Parameter
Sym
Min
Typ
Max
Unit
Test Condition
3 dB bandwidth
At13db
-
5
-
MHz
Input voltage range
At1iv
0
-
VCC
V
Output voltage range
At2ov
0
-
VCC
V
Table 43. Transmit Timing Characteristics
Parameter
Sym
Min
Typ
Max
Unit
Test Condition
Master clock frequency
E1
MCLK
–
2.048
–
MHz
T1
MCLK
–
1.544
–
MHz
Master clock tolerance
–
-100
–
100
ppm
Master clock duty cycle
–
40
–
60
%
Output pulse width
E1
Tw
219
244
269
ns
T1
Tw
291
324
356
ns
Transmit clock frequency
E1
Tclke1
-
2.048
-
MHz
T1
Tclkt1
-
1.544
-
MHz
Transmit clock tolerance
Tclkt
-50
–
+50
ppm
Transmit clock burst rate
Tclkb
-
–
20
MHz
Gapped transmit clock
Transmit clock duty cycle
Tdc
10
–
90
%
NRZ mode
E1 TPOS/TNEG pulse width (RZ mode)
Tmpwe1
236
–
252
ns
RZ mode (TCLK = H for
>16 clock cycles)
TPOS/TNEG to TCLK setup time
Tsut
20
-
-
ns
TCLK to TPOS/TNEG hold time
Tht
20
-
-
ns
Delay time OE Low to driver High Z
Toez
-
-
1
μ
s
Delay time TCLK Low to driver High Z
Ttz
50
60
75
μ
s
Figure 18. Transmit Clock Timing Diagram
TPOS
TNEG
TCLK
tHT
tSUT
相關PDF資料 |
PDF描述 |
|---|---|
| LXT400 | All Rate Extended Range Switched 56/DDS Transceiver |
| LXT441 | Switched 56/DDS Integrated DSU/CSU |
| LXT6155 | 155 Mbps SDH/SONET/ATM Transceiver |
| LXT6234 | E-Rate Multiplexer |
| LXT901 | 8QLYHUVDO (WKHUQHW 7UDQVFHLYHU |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| LXT386BE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PCM TRANSCEIVER|QUAD|CEPT PCM-30/E-1|CMOS|BGA|160PIN|PLASTIC |
| LXT386LE | 制造商:LEVEL1 功能描述: |
| LXT388LE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PCM TRANSCEIVER|DUAL|CEPT PCM-30/E-1|CMOS|QFP|100PIN|PLASTIC |
| LXT400 | 制造商:LVL1 制造商全稱:LVL1 功能描述:All Rate Extended Range Switched 56/DDS Transceiver |
| LXT400JE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Transceiver Circuit For Telecommunications |
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