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參數(shù)資料
| 型號： | PM2329 |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 106/162頁 |
| 文件大小： | 1581K |
| 代理商： | PM2329 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁當(dāng)前第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁
Proprietary and Confidential to PMC-Sierra, Inc and for its Customers
’
Internal Use
Document ID: PMC-2010146, Issue 4
109
PM2329 ClassiPI Network Classification Processor Datasheet
If a field cannot be extracted due to an extraction error, or if the extraction was disabled, then the
corresponding fields in the extracted header are loaded with the default values shown below:
SIP:0FFFF FFFFh
DIP:0000 0000h
Protocol: 0000h
SP: 0000h
DP: 0000h
Flags (SYN FIN and ACK): 0
OC Sequence Mode
This bit is a don
’
t care if the OC Trace Enable bit is
‘
1
’
.
If the OC Trace Enable bit is
‘
0
’
and this bit is
‘
0
’
, OC Sequencing is automatic and PM2329 terminates
packet processing at the end of the OC sequence.
If the OC Trace Enable bit is
‘
0
’
and this bit is
‘
1
’
, OC Sequencing is under processor control. At the
end of the current OC Sequence specified in the OCC word, the PM2329 retains the current packet and
enters a wait condition. It permits the processor to control the next sequence of OCs to be executed. For
further description of this bit, see OC Sequencing description in Chapter 5.
OC Trace Enable
When this bit is 1, the PM2329 executes an OC and enters a break condition (if the OC just executed
was not the last OC in the sequence) or a wait condition (if the OC just executed was the last OC in the
sequence). For further description of break and wait conditions, see the Alternate OCC register
description.
The table below shows the operation of the device based on the setting of the OC Sequencing Mode and
OC Trace Enable bits.
Layer 3 Header Offset
These 10 bits specify the start of the Layer 3 header with respect to the start ofthe packet. This field is
used only if Auto L3 Header Extraction is enabled and the Ethernet Framing bit is
’
0
’
.
Table 24
Processor Controlled OC Sequencing & Trace OC Execution
OC Trace
Enable
OC Sequence
Mode
Operation
0
0
Automated OC sequencing operation
(original PM2328 compatible operation)
Processor controlled OC sequencing (wait
after each OC sequence)
Trace OC sequencing--break after each OC
execution and wait after each OC sequence
0
1
1
X
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PDF描述 |
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| PM30RHC060 | TRANSISTOR | IGBT POWER MODULE | 3-PH BRIDGE | 600V V(BR)CES | 30A I(C) |
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