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參數(shù)資料
| 型號： | T7630 |
| 廠商： | Lineage Power |
| 英文描述： | Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)(雙 T1/E1 5.0V短距離通信終端器) |
| 中文描述： | 雙T1/E1的5.0V的短途終結(jié)者（終結(jié)者-Ⅱ）（雙個T1/E1 5.0V短距離通信終端器） |
| 文件頁數(shù)： | 185/210頁 |
| 文件大?。?/td> | 3075K |
| 代理商： | T7630 |
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Lucent Technologies Inc.
Lucent Technologies Inc.
185
Preliminary Data Sheet
October 2000
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)
Framer Register Architecture
(continued)
CHI Transmit Time-Slot Enable Registers (FRM_PR49—FRM_PR52)
These four registers define which transmit CHI time slots are enabled. A 1 enables the TCHIDATA or TCHIDATAB
time slot. A 0 forces the CHI transmit highway time slot to be 3-stated. The default value of this register is 00 (hex).
Table 172. CHI Transmit Time-Slot Enable Registers (FRM_PR49—FRM_PR52) ((691—694); (C91—C94))
CHI Receive Time-Slot Enable Registers (FRM_PR53—FRM_PR56)
These four registers define which receive CHI time slots are enabled. A 1 enables the RCHIDATA or RCHIDATAB
time slots. A 0 disables the time slot and transmits the programmable idle code of register FRM_PR22 to the line in
the corresponding time slot. The default value of this register is FF (hex).
Table 173. CHI Receive Time-Slot Enable Registers (FRM_PR53—FRM_PR56) ((695—698); (C95—C98))
CHI Transmit Highway Select Registers (FRM_PR57—FRM_PR60)
These four registers define which transmit CHI highway TCHIDATA or TCHIDATAB contains valid data for the active
time slot. A 0 enables TCHIDATA, and a 1 enables TCHIDATAB. The default value of this register is
00 (hex).
Table 174. CHI Transmit Highway Select Registers (FRM_PR57—FRM_PR60) ((699—69C); (C99—C9C))
Register
FRM_PR49
FRM_PR50
FRM_PR51
FRM_PR52
Bit
7—0
7—0
7—0
7—0
Symbol
Description
TTSE31—TTSE24
Transmit Time-Slot Enable Bits 31—24.
TTSE23—TTSE16
Transmit Time-Slot Enable Bits 23—16.
TTSE15—TTSE8
Transmit Time-Slot Enable Bits 15—8.
TTSE7—TTSE0
Transmit Time-Slot Enable Bits 7—0.
Register
FRM_PR53
FRM_PR54
FRM_PR55
FRM_PR56
Bit
7—0
7—0
7—0
7—0
Symbol
Description
RTSE31—RTSE24
Receive Time-Slot Enable Bits 31—24.
RTSE23—RTSE16
Receive Time-Slot Enable Bits 23—16.
RTSE15—RTSE8
Receive Time-Slot Enable Bits 15—8.
RTSE7—RTSE0
Receive Time-Slot Enable Bits 7—0.
Register
FRM_PR57
FRM_PR58
FRM_PR59
FRM_PR60
Bit
7—0
7—0
7—0
7—0
Symbol
THS31—THS24
THS23—THS16
THS15—THS8
THS7—THS0
Description
Transmit Highway Select Bits 31—24.
Transmit Highway Select Bits 23—16.
Transmit Highway Select Bits 15—8.
Transmit Highway Select Bits 7—0.
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