- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄376460 > XRT7245 (Exar Corporation) DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號(hào)： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) |
| 中文描述： | DS3自動(dòng)柜員機(jī)用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口） |
| 文件頁(yè)數(shù)： | 24/324頁(yè) |
| 文件大?。?/td> | 4103K |
| 代理商： | XRT7245 |
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
24
146
TxAddr4
I
Transmit UTOPIA Address Bus—MSB Input:
This input pin, along with TxAddr3
through TxAddr0 comprise the Transmit UTOPIA Address Bus input pins. The Trans-
mit UTOPIA Address Bus is only in use when the UNI is operating in the M-PHY
mode. When the ATM Layer processor wishes to write data to a particular UNI device,
it will provide the address of the “intended UNI” on the Transmit UTOPIA Address Bus.
The contents of the Transmit UTOPIA Address Bus input pins are sampled on the ris-
ing edge of TxClk. The DS3 UNI will compare the data on the Transmit UTOPIA
Address Bus with the pre-programmed contents of the TxUT Address Register
(Address = 70h). If these two values are identical and the TxENB pin is asserted, then
the TxClav pin will be driven to the appropriate state (based upon the TxFIFO fill level)
for the Cell Level handshake mode of operation.
147
TxAddr0
I
Transmit UTOPIA Address Bus Input—LSB:
(See Description for TxAddr4)
148
TxAddr3
I
Transmit UTOPIA Address Bus Input:
(See Description for TxAddr4)
149
TxAddr1
I
Transmit UTOPIA Address Bus Input:
(See Description for TxAddr4)
150
TxAddr2
I
Transmit UTOPIA Address Bus Input:
(See Description for TxAddr4)
151
TxClk
I
Transmit UTOPIA Interface Clock:
The Transmit UTOPIA Interface clock is used to
latch the data on the Transmit UTOPIA Data bus, into the Transmit UTOPIA Interface
block. This clock signal is also used as the timing source for circuitry used to process
the ATM cell data into and through the TxFIFO.
During Multi-PHY operation, the data on the Transmit UTOPIA Address bus pins is
sampled on the rising edge of TxClk.
152
GND
***
Ground Signal Pin
153
GND
***
Ground Signal Pin
154
TxGFCMSB
O
Transmit GFC Nibble-Field Serial Input Port—MSB Indicator:
This signal, along with
TxGFC and TxGFCClk combine to function as the “Transmit GFC Nibble Field” serial
input port. This output signal will pulse “high” when the MSB (most significant bit) of
the GFC Nibble (for a given cell) is expected at the TxGFC input pin.
155
ResetB
I
Reset Input:
When this “active-low” signal is asserted, the UNI device will be asyn-
chronously reset. Additionally, all outputs will be “tri-stated”, and all on-chip registers
will be reset to their default values.
156
TxGFCClk
O
Transmit GFC Nibble Field Serial Input Port Clock:
This signal, along with TxGFC,
and TxGFCMSB combine to function as the “Transmit GFC Nibble-field” serial input
port. The “Transmit GFC Nibble-field” serial input port uses this output clock signal to
sample the values applied to the TxGFC pin, on its rising edge. This pin will provide
four rising edges for each cell being transmitted.
157
ALE_AS
I
Address Latch Enable/Address Strobe:
This input is used to latch the address
(present at the Microprocessor Interface Address Bus, A[8:0]) into the UNI Micropro-
cessor Interface circuitry and to indicate the start of a READ/WRITE cycle. This input
is active-high in the Intel Mode (MOTO = “l(fā)ow”) and active-low in the Motorola Mode
(MOTO = “high”).
158
TxGFC
I
Transmit GFC Nibble-Field Serial Input Port:
This signal, along with TxGFCClk and
TxGFCMSB combine to function as the “Transmit GFC Nibble-field” serial input port.
The user will specify the value of the GFC field, within a given ATM cell, by serial
transmitting its four bit value into this input. Each of these four bits will be clocked into
the UNI via rising edge of the TxGFCClk clock output signal.
159
GND
***
Ground Signal Pin
PIN DESCRIPTION (CONT’D)
P
IN
N
O
.
S
YMBOL
T
YPE
D
ESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT7288IP | CEPT1 Line Interface |
| XRT7288 | CEPT1 Line Interface(CEPT1線接口) |
| XRT7288IW | CEPT1 Line Interface |
| XRT7295AE | E3 (34.368Mbps) Integrated line Receiver |
| XRT7295AE_03 | E3 (34.368Mbps) Integrated line Receiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT7250 | 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:DS3/E3 FRAMER IC |
| XRT7250ES-PCI | 功能描述:界面開(kāi)發(fā)工具 Evaluation Board for XRT7250 Series RoHS:否 制造商:Bourns 產(chǎn)品:Evaluation Boards 類(lèi)型:RS-485 工具用于評(píng)估:ADM3485E 接口類(lèi)型:RS-485 工作電源電壓:3.3 V |
| XRT7250IQ100 | 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:DS3/E3 FRAMER IC |
| XRT7288 | 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:CEPT1 Line Interface |
| XR-T7288 | 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:CEPT1 Line Interface |
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