參數(shù)資料
型號(hào)： XRT7245
廠商： Exar Corporation
英文描述： DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口)
中文描述： DS3自動(dòng)柜員機(jī)用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口）
文件頁數(shù)： 310/324頁
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代理商： XRT7245
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
X
Bit 1—RLOOP (Remote Loop-back Select) ................................................................................................141
Bit 0—LLOOP (Local Loop-back Select) ....................................................................................................141
Bit-Fields within the Line Interface Scan Register ...................................................... 142
Address = 73h, Line Interface Scan Register ............................................................................................142
Bit 2—DMO (Drive Monitor Output) ............................................................................................................142
Bit 1—RLOL (Receive Loss of Lock) ..........................................................................................................142
Bit 0—RLOS (Receive Loss of Signal) .......................................................................................................142
6.0 TRANSMIT SECTION .............................................................................................. 143
Transmit UTOPIA Interface Block ................................................................................. 143
TxData[15:0] —Transmit UTOPIA Data Bus inputs ...................................................................................146
TxAddr[4:0]—Transmit UTOPIA Address Bus inputs ...............................................................................146
TxClk—Transmit UTOPIA Interface Block Clock signal input pin ...........................................................146
TxEnB*—Transmit UTOPIA Data Bus—Write Enable input .....................................................................146
TxPrty—Transmit UTOPIA—Odd Parity Bit Input Pin ...............................................................................146
TxSoC—Transmit UTOPIA—“Start of Cell” Indicator ...............................................................................146
Example-1 .....................................................................................................................................................147
Example-2 .....................................................................................................................................................147
TxClav/TFullB*—Tx FIFO Cell Available/TxFIFO Full* ..............................................................................147
Selecting the UTOPIA Data Bus Width .......................................................................................................147
UTOPIA Configuration Register: Address = 6Ah ......................................................................................147
UTOPIA Configuration Register: Address = 6Ah ......................................................................................148
Transmit UTOPIA Interrupt/Status Register (Address = 6Eh) ..................................................................148
Transmit UTOPIA FIFO Manager Features and Options ..........................................................................149
UTOPIA Configuration Register: Address = 6Ah ......................................................................................151
UTOPIA Configuration Register: Address = 6Ah ......................................................................................152
Transmit UTOPIA—Interrupt/Status Register (Address—6Eh) ................................................................152
Transmit UTOPIA FIFO Status Register (Address = 71h) .........................................................................153
TxFIFO Full ...................................................................................................................................................153
Tx FIFO Empty ..............................................................................................................................................153
UTOPIA Configuration Register: Address = 6Ah ......................................................................................153
Final Comments on Single-PHY Operation ...............................................................................................157
Tx UTOPIA Address Register (Address = 70h) .........................................................................................157
Rx UTOPIA Address Register (Address = 6Ch) ........................................................................................157
Polling Operation .........................................................................................................................................159
The ATM Layer Processor’s Role in the “Polling” Operation ..................................................................159
The UNI Devices Role in the “Polling” Operation .....................................................................................159
UNI Interrupt Status Register (Address = 05h) ..........................................................................................162
Tx UT Interrupt Enable /Status Register (Address-6Eh) ...........................................................................162
Bit 0—TCOCA Interrupt Status—Transmit UTOPIA Change of Cell Alignment Condition ...................163
Tx UT Interrupt Enable /Status Register (Address-6Eh) ...........................................................................163
Bit 1—Tx FIFO Overrun Interrupt Status ....................................................................................................163
Transmit UTOPIA Interrupt Enable /Status Register (Address—6Eh) ....................................................163
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PDF描述
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XRT7288 CEPT1 Line Interface(CEPT1線接口)
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XRT7250IQ100 制造商:EXAR 制造商全稱:EXAR 功能描述:DS3/E3 FRAMER IC
XRT7288 制造商:EXAR 制造商全稱:EXAR 功能描述:CEPT1 Line Interface
XR-T7288 制造商:EXAR 制造商全稱:EXAR 功能描述:CEPT1 Line Interface
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