參數(shù)資料
型號(hào)： GT-64111
廠商： Galileo Technology Services, LLC
英文描述： System Controller for RC4640, RM523X and VR4300 CPUs(用于RC4640, RM523X和 VR4300 CPUs的系統(tǒng)控制器)
中文描述： 系統(tǒng)控制器（用于RC4640，RM523X和VR4300處理器的系統(tǒng)控制器的RC4640，RM523X和VR4300處理器）
文件頁(yè)數(shù)： 100/130頁(yè)
文件大?。?/td> 881K
代理商： GT-64111
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GT-64111 System Controller for RC4640, RM523X and VR4300 CPUs
Revision 1.0
11.2.2 32-bit DRAM
Connecting 32-bit DRAM is the same for the odd and even bank. It is optional to have one bidirectional buffer.
Notes:
1. Example shows even bank choice, but odd bank can be selected instead.
2. Regardless of endianess,
ECAS[0]* always corresponds to SysAD[7:0], and AD[7:0].
ECAS[1]* always corresponds to SysAD[15:8], and AD[15:8].
ECAS[2]* always corresponds to SysAD[23:16], and AD[23:16].
ECAS[3]* always corresponds to SysAD[31:24], and AD[31:24].
3. Be careful if OEB is programmed at reset to have reverse polarity.
4. Signals can be optionally buffered for load balancing.
Co nnec t io n
Memory
Wi dth
Co nnec t .. .
To ...
DRAM Address4
32-bit
DAdr[11:0]
DRAM address pins
DRAM Data
(Latched)1,2
32-bit
AD[31:0]
Even latch I/Os B side
‘0’
LEE
OEE*
OEB3
Even latch I/Os A side
Even bank data pins
Even latch CLKAB and CLKBA
Even latch LEAB and LEBA
Even latch OEBA*
Even latch OEAB
DRAM Data
(No Latch)1,2
32-bit
AD[31:0]
Even bank data pins
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PDF描述
GT-96100A Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級(jí)通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器)
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GT5-1S-HU(A) RECTANGULAR CONNECTOR
GT5-1S-HU(B) RECTANGULAR CONNECTOR
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