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參數(shù)資料
| 型號(hào)： | GT-64111 |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | System Controller for RC4640, RM523X and VR4300 CPUs(用于RC4640, RM523X和 VR4300 CPUs的系統(tǒng)控制器) |
| 中文描述： | 系統(tǒng)控制器（用于RC4640，RM523X和VR4300處理器的系統(tǒng)控制器的RC4640，RM523X和VR4300處理器） |
| 文件頁數(shù)： | 61/130頁 |
| 文件大?。?/td> | 881K |
| 代理商： | GT-64111 |
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GT-64111 System Controller for RC4640, RM523X and VR4300 CPUs
36
Revision 1.0
to the next data will be latched (in burst accesses). This parameter can also be thought of as the delay between the ris-
ing edge of TClk which data is latched to the rising edge of TClk where the next data is latched in a burst cycle. This
parameter can be extended by the Ready* pin.
5.2.4
ADStoWr, bits[13:11]
There are eight byte write signals, four for even bank devices (EWr[3:0]*) and four for odd bank devices (OWr[3:0]*).
ADStoWr can also be thought as the delay between the rising edge of TClk which drives ADS* LOW (ALE HIGH) from
to the assertion of EWr* or OWr*, or for the first write pulse.
5.2.5
WrActive, bits[16:14]
WrActive is the number of TClks that EWr* and OWr* are active (asserted). This parameter is measured from the first
rising edge of TClk where EWr* or OWr* is asserted LOW to the last rising edge of TClk where EWr* or OWr* is LOW
for that particular write pulse. This parameter can be extended by the Ready* pin.
5.2.6
WrHigh, bits[19:17]
WrHigh is the number of TClks that EWr* and OWr* are inactive between burst writes. This parameter is measured
from the first rising edge of TClk where EWr* or OWr* is de-asserted HIGH to the last rising edge of TClk where EWr*
or OWr* is HIGH. On the next rising edge of TClk, EWr* and OWr* will be asserted LOW for the next write pulse.
These signals are driven off of the falling edge of TClk.
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PDF描述 |
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