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參數(shù)資料
| 型號： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 110/414頁 |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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Functional Description
5-60
82801AA and 82801AB Datasheet
5.12.8.3
Read Only Registers with Write Paths in Alternate Access Mode
The registers described in
Table 5-46
have write paths to them in alternate access mode. Software
restores these values after returning from a powered down state. These registers must be handled
special by software. When in normal mode, writing to the base address/count register also writes to
the current address/count register. Therefore, the base address/count must be written first, then the
part is put into alternate access mode and the current address/count register is written.
5.12.9
System Power Supplies, Planes, and Signals
Power Plane Control with SLP_S3# and SLP_S5#
The SLP_S3# output signal can be used to cut power to the system core supply, since it only goes
active for the STR state (typically mapped to ACPI S3). Power must be maintained to the ICH
Resume Well, and to any other circuits that need to generate Wake signals from the STR state.
Cutting power to the core may be done via the power supply, or by external FETs to the
motherboard. The SLP_S5# output signal can be used to cut power to the system core supply, as
well as power to the system memory, since the context of the system is saved on the disk. Cutting
power to the memory may be done via the power supply, or by external FETs to the motherboard.
PWROK Signal
The PWROK input should go active based on the core supply voltages becoming valid. PWROK
should go high at least 16 ms after the power is guaranteed valid.
Note:
Traditional designs have a reset button logically AND’d with the PWROK signal from the power
supply and the processor’s voltage regulator module. If this is done with the ICH, the
PWROK_FLR bit is set. The ICH treats this internally as if the RSMRST# signal had gone active.
However, it is not treated as a full power failure. If PWROK goes inactive and then active (but
RSMRST# stays high), the ICH will reboot (regardless of the state of the AFTERG3 bit). If the
RSMRST# signal also goes low before PWROK goes high, this is a full power failure, and the
reboot policy is controlled by the AFTERG3 bit.
Table 5-46. Register Write Accesses in Alternate Access Mode
I/O Address
Register Write Value
08h
DMA Status Register for channel’s 0-3.
D0h
DMA Status Register for channel’s 4-7.
相關PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復嵌入式增強型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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