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參數(shù)資料
| 型號： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 252/414頁 |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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LPC Interface Bridge Registers (D31:F0)
8-62
82801AA and 82801AB Datasheet
8.8.3.6
LV2 — Level 2 Register
I/O Address:
PMBASE + 14h
(
ACPI P_BLK+4)
00h
No
Core
Attribute:
Size:
Usage:
RO
8 bits
ACPI or Legacy
Default Value:
Lockable:
Power Well:
8.8.3.7
GPE0_STS—General Purpose Event 0 Status Register
I/O Address:
PMBASE + 28h
(
ACPI GPE0_BLK)
0000h
No
Resume
Attribute:
Size:
Usage:
R/W
16 bits
ACPI
Default Value:
Lockable:
Power Well:
Note:
This register is symmetrical to the General Purpose Event 0 Enable Register. If the corresponding
_EN bit is set, then when the _STS bit get set, the ICH generates a Wake Event. Once back in an S0
state (or if already in an S0 state when the event occurs), the ICH will also generate an SCI if the
SCI_EN bit is set, or an SMI# if the SCI_EN bit is not set. No SCI/SMI# or wake event on
THRMOR_STS since no corresponding _EN bit. None of these bits should be reset by CF9h write.
All should be reset by RSMRST#, except for RI_STS.
Bit
Description
7:0
Reads to this register return all zeros, writes to this register have no effect. Reads to this register
generate a “enter a level 2 power state” (C2) to the clock control logic. This will cause the STPCLK#
signal to go active, and stay active until a break event occurs. Throttling (due either to THTL_EN or
THRM# override) will be ignored.
Bit
Description
15:12
Reserved.
11
PME_STS.
1 = This bit is set to 1 by hardware when the PME# signal goes active. Additionally, if the PME_EN
bit is set, and the system is in an S0 state, then the setting of the PME_STS bit generates an
SCI or SMI# (if SCI_EN is not set). If the PME_EN bit is set, and the system is in an S1-S4 state
(or S5 state due to setting SLP_TYP and SLP_EN), then the setting of the PME_STS bit
generates a wake event, and an SCI is generated. If the system is in an S5 state due to power
button override or a power failure, then PME_STS does not cause a wake event or SCI.
10:9
Reserved.
8
RI_STS.
1 = This bit is set to 1 by hardware when the RI# input signal goes active. The value of this bit must
be maintained, even through a G3 state.
0 = This bit can be reset by writing a one to this bit position.
NOTE:
This bit is not effected by a hard reset caused by a CF9h write.
7
SMB_WAK_STS.
1 = This bit is set to 1 by hardware to indicate that the wake event was caused by the ICH’s SMBus
logic.
0 = This bit is cleared by writing back a 1 to this bit position.
The SMBus controller will independently cause an SMI# or SCI, so this bit does not need to do so
(unlike the other bits in this register). This bit is in resume well.
6
TCOSCI_STS.
1 = This bit will be set to 1 by hardware when the TCO logic causes an SCI.
0 = This bit can be reset by writing a one to this bit position.
相關PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復嵌入式增強型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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