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參數(shù)資料
| 型號： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 30/414頁 |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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Signal Description
2-2
82801AA and 82801AB Datasheet
2.3
PCI Interface
Table 2-3. PCI Interface Signals (Sheet 1 of 3)
Name
Type
Description
AD[31:0]
I/O
PCI Address/Data:
AD[31:0] is a multiplexed address and data bus. During the first
clock of a transaction, AD[31:0] contain a physical address (32 bits). During
subsequent clocks, AD[31:0] contain data. The ICH drives all 0’s on AD[31:0] during the
address phase of PCI Interrupt Acknowledge cycles.
C/BE[3:0]#
I/O
Bus Command and Byte Enables:
The command and byte enable signals are
multiplexed on the same PCI pins. During the address phase of a transaction,
C/BE[3:0]# define the bus command. During the data phase, C/BE[3:0]# define the
Byte Enables.
C/BE[3:0]#
Command Type
0 0 0 0
Interrupt Acknowledge
0 0 0 1
Special Cycle
0 0 1 0
I/O Read
0 0 1 1
I/O Write
0 1 1 0
Memory Read
0 1 1 1
Memory Write
1 0 1 0
Configuration Read
1 0 1 1
Configuration Write
1 1 0 0
Memory Read Multiple
1 1 1 0
Memory Read Line
1 1 1 1
Memory Write and Invalidate
NOTE:
All command encodings not shown are reserved. The ICH does not decode
reserved values, and, therefore, does not respond if a PCI master generates a
cycle using one of the reserved values.
DEVSEL#
I/O
Device Select:
The ICH asserts DEVSEL# to claim a PCI transaction. As an output,
the ICH asserts DEVSEL# when a PCI master peripheral attempts an access to an
internal ICH register or man memory. As an input, DEVSEL# indicates the response to
an ICH-initiated transaction on the PCI bus. DEVSEL# is tri-stated from the leading
edge of PCIRST#. DEVSEL# remains tri-stated by the ICH until driven by a Target
device.
FRAME#
I/O
Cycle Frame:
The current Initiator drives FRAME# to indicate the beginning and
duration of a PCI transaction. While the initiator asserts FRAME#, data transfers
continue. When the initiator negates FRAME#, the transaction is in the final data
phase. FRAME# is an input to the ICH when the ICH is the target, and FRAME# is an
output from the ICH when the ICH is the Initiator. FRAME# remains tri-stated by the
ICH until driven by an Initiator.
IRDY#
I/O
Initiator Ready:
IRDY# indicates the ICH's ability, as an Initiator, to complete the
current data phase of the transaction. It is used in conjunction with TRDY#. A data
phase is completed on any clock both IRDY# and TRDY# are sampled asserted.
During a write, IRDY# indicates the ICH has valid data present on AD[31:0]. During a
read, it indicates the ICH is prepared to latch data. IRDY# is an input to the ICH when
the ICH is the Target and an output from the ICH when the ICH is an Initiator. IRDY#
remains tri-stated by the ICH until driven by an Initiator.
TRDY#
I/O
Target Ready:
TRDY# indicates the ICH's ability as a Target to complete the current
data phase of the transaction. TRDY# is used in conjunction with IRDY#. A data phase
is completed when both TRDY# and IRDY# are sampled asserted. During a read,
TRDY# indicates that the ICH, as a Target, has placed valid data on AD[31:0]. During a
write, TRDY# indicates the ICH, as a Target is prepared to latch data. TRDY# is an
input to the ICH when the ICH is the Initiator and an output from the ICH when the ICH
is a Target. TRDY# is tri-stated from the leading edge of PCIRST#. TRDY# remains tri-
stated by the ICH until driven by a target.
相關PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復嵌入式增強型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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