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參數(shù)資料
| 型號： | XPC801ZP40 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 314/605頁 |
| 文件大?。?/td> | 2380K |
| 代理商： | XPC801ZP40 |
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Memory Controller
MOTOROLA
MPC801 USER’S MANUAL
15-27
15
19
G4T3/WAEN
When GPL4_xDIS = 0 in the corresponding MxMR:
G4T3/WAEN = 0 means the value of the GPL4 signal at the trailing edge of GCLK1 will be ‘0’
G4T3/WAEN = 1 means the value of the GPL4 signal at the trailing edge of GCLK1 will be ‘1’
When GPL4_xDIS = 1 in the corresponding MxMR:
G4T3/WAEN = 1 in the current word indicates that a “freeze” in the external signals logical value
will occur if the external WAIT signal is asserted. This condition lasts until the WAIT
signal is negated.
20
G5T4
G5T4 = 0 means the value of the GPL5 signal at the trailing edge of GCLK2 will be ‘0’
G5T4 = 1 means the value of the GPL5 signal at the trailing edge of GCLK2 will be ‘1’
21
G5T3
G5T3 = 0 means the value of the GPL5 signal at the trailing edge of GCLK1 will be ‘0’
G5T3 = 1 means the value of the GPL5 signal at the trailing edge of GCLK1 will be ‘1’
22-23
Reserved
—
24
LOOP
LOOP = 1 indicates that the current word is the start or end of a loop subpattern.
The first word in a pattern where the LOOP bit is ‘1’ is marked as the LOOP START WORD. The next
word in the same pattern where the LOOP bit is ‘1’ is marked as the LOOP END WORD. The user-
programmable machine runs the subpattern between the LOOP START WORD and
LOOP END WORD many times as defined in the corresponding loop field of the MxMR.
25
EXEN
EXEN = 1 in the current word indicates that a “branch” to the exception pattern is enabled after the
current cycle if an exception condition is detected. The exception condition can be an external device
asserting TEA or an external reset request.
26-27
AMX(0:1)
AMX = 00 means the value of the A[0:31] signals at the trailing edge of GCLK1 will be the address
requested by the internal master for the external access. Ex: Column address.
AMX = 10 means the value of the A[0:31] signals at the trailing edge of GCLK1 will be the address
requested by the internal master for the external access multiplexed according to the one specified in
the AMA/AMB bits of the MAMR/MBMR. Ex: Row address.
AMX = 11 means the value of the A[0:31] signals at the trailing edge of GCLK1 will be the contents of
the MAR. Ex: SDRAM mode initialization.
28
NA
NA = 1 if the port size of the accessed bank is 32 bits, the value of the address lines A[28:31]
at the trailing edge of GCLK1 will be incremented by 4.
NA = 1 if the port size of the accessed bank is 16 bits, the value of the A[28:31] signals at the trailing
edge of GCLK1 will be incremented by 2.
NA = 1 if the port size of the accessed bank is 8 bits, the value of the A[28:31] signals at the trailing edge
of GCLK1 will be incremented by 1.
NA = 0 means the address increment is disabled.
NOTE:
The value of the NA bit is relevant only when the UPM serves a burst-read or burst-write
request. Under other patterns this bit is reserved.
29
UTA
This line indicates the value of the TA signal sampled by the system interface unit in the current cycle.
The TA signal is output at the rising edge of GCLK2.
30
TODT
TODT = 1 if the disable timer for the current accessed bank is turned on. This avoids a new access
to the same bank (when controlled by any of the user-programmable machines) until the disable timer
is expired. Ex: Precharge time.
31
LAST
LAST = 1 means the service to the UPM request is done
Table 15-2. UPM RAM Word (Continued)
BITS
MNEMONIC
FUNCTION
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