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參數(shù)資料
| 型號： | XPC801ZP40 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 425/605頁 |
| 文件大?。?/td> | 2380K |
| 代理商： | XPC801ZP40 |
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Development Support
18-14
MPC801 USER’S MANUAL
MOTOROLA
18
Result: The event will be correctly detected if the compiler chooses a load/store instruction
with data size of half-word. If the compiler chooses load/store instructions with data size
greater than half-word (word, multiple), there might be some false detections.
These examples can only be ignored by the software that handles the breakpoints. The
following figure illustrates this partially supported scenario:
Figure 18-2. Partially Supported Watchpoints/Breakpoint Example
18.2.1.4 CONTEXT DEPENDENT FILTER.
recognize internal breakpoints when the MSR
recognize internal breakpoints (nonmasked mode). When it is programmed to recognize
internal breakpoints (when MSR
RI
=1), all parts of the code can be debugged, except when
registers SRR0 and SRR1, DAR, and DSISR are busy and MSR
epilogues of interrupt/exception handlers).
The core can only be programmed to
bit is set (masked mode) or to always
RI
RI
=0 (in the prologues and
When working in masked mode, all internal breakpoints detected when MSR
and detected watchpoints are not counted by the debug counters. Detected watchpoints are
always reported on the external pins, regardless of the value of the MSR
defaults to masked mode after reset. It is input in the nonmasked mode by setting the
BRKNOMSK bit in the LCTRL2 register.The BRKNOMSK bit controls all internal
breakpoints (I-breakpoints and L-breakpoints). See Table 18-14 for details.
RI
=0 are lost
RI
bit. The core
18.2.1.5 IGNORE FIRST MATCH OPTION.
and “go from x”, the ignore first match option is supported for the instruction breakpoints.
When an instruction breakpoint is first enabled, the first instruction will not cause an
instruction breakpoint if the IFM bit in the instruction support control (ICTRL) register is set.
This is used for “continue” utilities. When IFM is clear, every matched instruction can cause
an instruction breakpoint. This is used for “go from x”. The IFM bit is set by the software and
cleared by the hardware following the first instruction breakpoint, the match is ignored. Load/
store breakpoints and all counter-generated breakpoints (instruction and load/store) are
unaffected by this mode.
To facilitate the debugger utilities of “continue”
0X00000000
0X00000004
0X00000008
0X0000000C
0X00000010
POSSIBLE FALSE DETECT ON THESE HALF-WORDS WHEN USING WORD/MULTIPLE
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PDF描述 |
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| XPC823CZC66A | 制造商:Freescale Semiconductor 功能描述: |
| XPC823CZT66B2 | 制造商:Freescale Semiconductor 功能描述: |
| XPC823CZT66B2T | 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤 |
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