參數(shù)資料
型號： XPC801ZP40
元件分類： 微處理器
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 81/605頁
文件大?。?/td> 2380K
代理商： XPC801ZP40
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Clocks and Power Control
5-14
MPC801 USER’S MANUAL
MOTOROLA
5
TBS—Timebase Source
This bit determines the clock source that drives the timebase and decrementer.
0 = TB frequency source is the crystal oscillator frequency divided by 4 or 16.
1 = TB frequency source is the system clock divided by 16.
RTDIV—Real-Time Clock Divide
This bit indicates if the clock to the real-time clock and periodic interrupt timer is additionally
divided by 128. At power-on reset this bit is cleared if both MODCK[1] and MODCK[2] are
zeros. Otherwise, it is set.
0 = The real-time clock and periodic interrupt timer are divided by 4.
1 = The real-time clock and periodic interrupt timer are divided by 512.
RTSEL—Real-Time Clock Circuit Input Source Select
This bit specifies the input source to the real-time clock. At power-on reset, this bit receives
the value of the MODCK[1] bit.
0 = The real-time clock and periodic interrupt timer are divided by 4.
1 = The real-time clock and periodic interrupt timer are divided by 512.
PRQEN—Power Management Request Enable
This bit specifies whether or not the general system clock returns to the high frequency
defined by DFNH while there is a pending interrupt from the interrupt controller or POW bit
in the machine state register is clear. This bit is cleared by power-on or hard reset.
0 = The system remains in the lower frequency defined by DFNL even if there is a
pending interrupt from the interrupt controller or POW bit in the machine state
register is cleared.
1 = The system switches to high frequency defined by DFNH when there is a pending
interrupt from the interrupt controller or POW bit in the machine state register is
cleared.
Bits 11–12 and 15–16—Reserved
These bits are reserved and should be set to 0.
EBDF—External Bus Division Factor
These bits define the frequency division factor between GCLK1/GCLK2 and GCLK1_50/
GCLK2_50. CLKOUT is similar to GCLK2_50. The GCLK2_50 and GCLK1_50 are used by
the external master, bus interface, and memory controller to interface with the external
system. These bits are initialized during HRESET using the hard reset configuration
mechanism.
00 = CLKOUT is GCLK2 divided by 1.
01 = CLKOUT is GCLK2 divided by 2.
1x = Reserved.
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PDF描述
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XPC823CZT66B2T 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤
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