參數(shù)資料
型號： XPC801ZP40
元件分類： 微處理器
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 93/605頁
文件大小： 2380K
代理商： XPC801ZP40
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The PowerPC Core
6-2
MPC801 USER’S MANUAL
MOTOROLA
6
6.1.1 Basic Structure of the Core
To accomplish its tasks, the core is divided into the following subunits:
Sequencer Unit
and the interrupt handling mechanism. It controls some data structures within the
register unit.
Register Unit
—Consists of all the user-visible registers, the register’s scoreboard
mechanism, and a history of previous operations to allow for a precise interrupt model.
This module is physically split so that each data structure is implemented near the area
where it is used.
Fixed-Point Unit
—Consists of all fixed-point instruction implementations, except load/
store. This module is subdivided into the following two execution units:
— IMUL/IDIV—Fixed-point multiply and divide instruction implementations
— ALU/BFU—Fixed-point logic, add, and subtract instruction implementations, as well
as the bit field instructions.
Load/Store Unit
—Consists of all load and store instructions, except floating-point
processor load and store.
—Consists of the branch processor, the instruction prefetch queue,
6.1.2 Instruction Flow Within the Core
When fetched, instructions enter the instruction queue, thus enabling branch folding by
allowing out-of-order branch execution. Nonbranch instructions reaching the top of the
instruction queue are issued to the execution units. Instructions can be flushed from the
instruction queue when an exception on a previous instruction, interrupt, or miss-predicted
fetch occurs.
All instructions, including branches, enter the history buffer along with processor state
information that can be affected by the instruction’s execution. This information is used to
enable out-of-order completion of instructions together with precise exception handling.
When exceptions or interrupts occur, instructions can be flushed or recovered from the
machine. The instruction queue is always flushed when the history buffer is recovered. An
instruction retires from the machine after it finishes executing without exception and all
preceding instructions are retired from the machine. Figure 6-1 illustrates the core’s
microarchitecture.
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PDF描述
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XPC823ZP25 Microprocessor
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XPC8241LZP166 Microprocessor
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參數(shù)描述
XPC821ZP40 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor
XPC823CVR66B2T 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤
XPC823CZC66A 制造商:Freescale Semiconductor 功能描述:
XPC823CZT66B2 制造商:Freescale Semiconductor 功能描述:
XPC823CZT66B2T 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤
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