- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄67672 > GT-96100A (Galileo Technology Services, LLC) Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) PDF資料下載
參數(shù)資料
| 型號： | GT-96100A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) |
| 中文描述： | 先進的通信控制器能夠處理的串行通信協(xié)議，范圍廣，如以太網(wǎng)，快速以太網(wǎng)，和HDLC（通信協(xié)議的高級通信協(xié)議（以太網(wǎng)，快速以太網(wǎng)，HDLC的）控制器） |
| 文件頁數(shù)： | 325/549頁 |
| 文件大?。?/td> | 7321K |
| 代理商： | GT-96100A |
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GT-96100A Advanced Communication Controller
Revision 1.0
391
NOTE: The C/I channel messages are 4 bits wide. The message must be duplicated to create an 8-bit word,
which is written to the 8-bit ATB register.
When the transmit FlexTDM loses synchronization (i.e. when the SYNC signal is asserted not where expected),
the auxiliary channel B transmitter flushes its shift register and stop its transmit process. The transmit process
restarts when the FlexTDM regains synchronization.
The auxiliary channel B receiver generates an interrupt after it loads into ARB register a new C/I command. A
new command is recognized when it is different from the previous loaded command. The channel receiver sets
the V bit whenever it loads data into the ARB register. The CPU clears the V bit when it reads ARB.
When the receive FlexTDM loses synchronization, the auxiliary channel B receiver flushes its shift register and
stops its receive process. The receive process restarts when the FlexTDM regains synchronization. The ARB
contents are not affected by synchronization lost.
NOTES:The GT-96100A sets the V bit whenever it loads data, even if no new command was received. However,
the GT-96100A interrupts the CPU only when new command was received.
When the FlexTDM loses synchronization (i.e., when SYNC is not asserted where expected), the V bit
is cleared, even if new data has been loaded into ATB register. This prevents the new data from being
transmitted. The driver software must rewrite the data to the ATB register when there is loss of synchro-
nization (Loss of synchronization can be recognized using an interrupt or by polling).
15.10 IOM Programing
Table 359 , Table 360 and Table 361 provide the recommended DPRAM programming for the IOM bus. If IOM
mode is selected, the programming recommendations must be followed for the appropriate collision resolution
process.
NOTE: In these tables, B channels mask bits are set to ‘1’. However, the CPU must complete layer-2 negotia-
tions before granting a MPSC access to one of the B channels.
Table 359: IOM-1 Programming
En try
Numb er
L
RPT
STRB
B
CH
MASK
Comments
0
00
xx
1
00000
11111111
B channel 0 to MPSC0 (1 byte).
1
0
00
xx
1
00001
11111111
B channel 1 to MPSC1 (1 byte).
2
0
00
xx
1
11110
11111111
Monitor to AUXA (1 byte).
3
0
01
xx
0
00010
00000110
D channel to MPSC2 (2 bits).
NOTE: The MASK setting for D
channel data.
4
0
11
xx
0
11111
00000010
C/I to AUXB (4 bits).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| GT5-2/1S-HU | RECTANGULAR CONNECTOR |
| GT5-1S-HU(A) | RECTANGULAR CONNECTOR |
| GT5-1S-HU(B) | RECTANGULAR CONNECTOR |
| GT5-2S-HU | RECTANGULAR CONNECTOR |
| GT5-4S-HU | RECTANGULAR CONNECTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| GT96100AB3-BBF-C000 | 制造商:Marvell 功能描述:Marvell GT96100AB3-BBF-C000 |
| GT96100AB3-BBF-C083 | 制造商:Marvell 功能描述:Marvell GT96100AB3-BBF-C083 |
| GT96103AB3-BBF-C083 | 制造商:Marvell 功能描述: 制造商:Marvell 功能描述:Marvell GT96103AB3-BBF-C083 |
| GT96122-A2-BBF1C000 | 制造商:Marvell 功能描述:Marvell GT96122-A2-BBF1C000 |
| GT96122-Ax-BBF-C000 | 制造商:Marvell 功能描述:64-BIT MIPS COMMUNICATION CONTROLLER & INTEGRATED NETGX COPR - Trays |
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