- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄67672 > GT-96100A (Galileo Technology Services, LLC) Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級(jí)通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) PDF資料下載
參數(shù)資料
| 型號(hào)： | GT-96100A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級(jí)通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) |
| 中文描述： | 先進(jìn)的通信控制器能夠處理的串行通信協(xié)議，范圍廣，如以太網(wǎng)，快速以太網(wǎng)，和HDLC（通信協(xié)議的高級(jí)通信協(xié)議（以太網(wǎng)，快速以太網(wǎng)，HDLC的）控制器） |
| 文件頁數(shù)： | 364/549頁 |
| 文件大?。?/td> | 7321K |
| 代理商： | GT-96100A |
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GT-96100A Advanced Communication Controller
426
Revision 1.0
21.3
Interrupt Summaries
The GT-96100A provides the following three interrupt summary bits in the main cause register:
IntSum (bit [0] in the Main_Cause register) is the logical OR of all interrupt bits in both the
Main_Cause and High_Cause registers. This OR is not affected by the state of the mask bits and can be
used for event polling.
Int0*Sum (bit [30] in the Main_Cause register) is the logical OR of all interrupt bits in both the
Main_Cause and High_Cause registers masked by Interrupt0* mask registers. It serves as an indication
that at least one of the (unmasked) Interrupt0* events is set.
Int1*Sum (bit [31] in the Main_Cause register) is the logical OR of all interrupt bits in both the
Main_Cause and High_Cause registers masked by Interrupt1* mask registers. It serves as an indication
that at least one of the (unmasked) Interrupt1* events is set.
21.4
Interrupt Select Registers
There are two interrupt select registers that can be used to optimize interrupt service routines. One select register
is associated with Interrupt0* (offset 0x000C70) and another register is associated with interrupt1* (offset
0x000C74).
These select registers optimize service routines is the following manner:
Instead of checking BOTH the Main_Cause register and the High_Cause register, when interrupted, the
CPU has the option to read the appropriate select register.
The select register will reflect the Cause register bits of either the Main_Cause or the High_Cause regis-
ters, depending on which register has active unmasked interrupt bits.
Bit [30] of the select register indicates which of the cause registers (Main or High) is selected and bits
[29:0] reflect the state of the interrupt bits of the selected cause register. For example, if bit [5] of the
High_Cause register is set (and is unmasked), and no (unmasked) bit in the Main_Cause register is set,
then bit [5] of the select register is set as well. In addition, bit [30] of the select register is set, indicating
that the High_Cause register is currently being selected.
In case both the Main_Cause and the High_Cause registers have interrupt bits set, the select register reflects the
state of the Main_Cause register (and bit [30] is therefore reset). However, in order to indicate that both cause
registers are active, bit [31] of the select register is also set, in this case.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| GT5-2/1S-HU | RECTANGULAR CONNECTOR |
| GT5-1S-HU(A) | RECTANGULAR CONNECTOR |
| GT5-1S-HU(B) | RECTANGULAR CONNECTOR |
| GT5-2S-HU | RECTANGULAR CONNECTOR |
| GT5-4S-HU | RECTANGULAR CONNECTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| GT96103AB3-BBF-C083 | 制造商:Marvell 功能描述: 制造商:Marvell 功能描述:Marvell GT96103AB3-BBF-C083 |
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| GT96122-Ax-BBF-C000 | 制造商:Marvell 功能描述:64-BIT MIPS COMMUNICATION CONTROLLER & INTEGRATED NETGX COPR - Trays |
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