- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄67672 > GT-96100A (Galileo Technology Services, LLC) Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) PDF資料下載
參數(shù)資料
| 型號： | GT-96100A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) |
| 中文描述： | 先進的通信控制器能夠處理的串行通信協(xié)議，范圍廣，如以太網(wǎng)，快速以太網(wǎng)，和HDLC（通信協(xié)議的高級通信協(xié)議（以太網(wǎng)，快速以太網(wǎng)，HDLC的）控制器） |
| 文件頁數(shù)： | 510/549頁 |
| 文件大?。?/td> | 7321K |
| 代理商： | GT-96100A |
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GT-96100A Advanced Communication Controller
Revision 1.0
63
3.2
Disabling Address Decoders
CPU interface address decoders can be disabled by setting the Low decoder value higher than the High decoder
value.
Device sub-decoder can be disabled by setting the Low decoder value higher than the High decoder value.
PCI address decoders can be disabled by setting the BAR’s corresponding bit in Base Address registers’ Enable
to 1.
3.3
DMA Unit Address Decoding
The IDMA controller uses the address mapping of the CPU interface.
NOTE: CPU interface address mapping to determine whether the source address is located in one of the
SDRAM banks, Device banks, PCI_0 or PCI_1. The same is true for destination address and next
record address.DMA address decoding is only up to address bit [31]. Bits [35:32] of CPU address
decoding registers are ignored.
3.4
Address Space Decoding Errors
When the CPU tries to access an address from the SysAD that is not supported, the GT-96100A:
Latches the address into the Bus Error Address registers (offsets 0x70,0x78).
Issues a bus error (over SysCmd[5]), if the access was a read access.
Issues an interrupt, if the access was a read or write access.
This feature is useful during software debugging, when errant code can cause fetches from unsupported
addresses.
When SysAD matches one of CPU interface address spaces, but misses the associated subdecoders, the GT-
96100A:
Issues a bus error (over SysCmd[5]), if the access was a read access.
Sets the MemOut bit in the Interrupt Cause register.
When a PCI access hits in a Base Address register then misses in the associated subdecoders:
Random data is returned on a read and write data is discarded.
Latches the address into the Address Decode Error register (offset 0x470).
The MemOut bit in the Interrupt Cause register is also set.
Accesses that miss all of the GT-96100A BARs result in no response at all from the GT-96100A.
When a DMA accesses an unmapped address, DMAOut bit in the interrupt Cause register is set.
NOTE: Never program address space decoders to overlap. Programming address space decoders to overlap
results in unpredictable behavior.
相關PDF資料 |
PDF描述 |
|---|---|
| GT5-2/1S-HU | RECTANGULAR CONNECTOR |
| GT5-1S-HU(A) | RECTANGULAR CONNECTOR |
| GT5-1S-HU(B) | RECTANGULAR CONNECTOR |
| GT5-2S-HU | RECTANGULAR CONNECTOR |
| GT5-4S-HU | RECTANGULAR CONNECTOR |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| GT96100AB3-BBF-C000 | 制造商:Marvell 功能描述:Marvell GT96100AB3-BBF-C000 |
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