- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄67672 > GT-96100A (Galileo Technology Services, LLC) Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) PDF資料下載
參數(shù)資料
| 型號： | GT-96100A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) |
| 中文描述： | 先進(jìn)的通信控制器能夠處理的串行通信協(xié)議，范圍廣，如以太網(wǎng)，快速以太網(wǎng)，和HDLC（通信協(xié)議的高級通信協(xié)議（以太網(wǎng)，快速以太網(wǎng)，HDLC的）控制器） |
| 文件頁數(shù)： | 518/549頁 |
| 文件大?。?/td> | 7321K |
| 代理商： | GT-96100A |
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GT-96100A Advanced Communication Controller
70
Revision 1.0
NOTE: The size register is programmed to 0x03FF.FFFF. This indicates that this BAR requires a hit in the six
MSB (bits 31:26) bits of the PCI address for their to be a hit in the BAR. Therefore, the PCI address
0x1DXX.XXXX is a hit in a BAR programmed to 0x1FXX.XXXX as bits 31-26 of both of these
addresses is 0b0001.11.
Then according to the Remap register, these same bit locations will be remapped to 6b111111. The rest
of the PCI address bits (i.e. [25:0]) remain unchanged. This means that the final PCI slave address will
be 0x3D987654.
3.6.4
Writing to Decode Registers
When a BAR register is written to, the associated remap register is written to, simultaneously. When a remap reg-
ister is written to, only its contents are affected.
Following RESET, the default value of a remap register is equal to its associated BAR decode register.
Unless a specific write operation to a remap register takes place, a 1:1 mapping is maintained. Also, changing a
BAR register’s contents automatically returns its associated space to a 1:1 mapping. This allows for backward
software compatibility with other Galileo Technology devices such as the GT-64010A and the GT-64011 core
logic devices.
3.7
Using the CPU PCI Override
In default, the CPU interface supports 512Mbyte PCI memory address space (256Mbyte on PCI_0 Mem0,
256Mbyte on PCI_0 Mem1). If configured to both PCI_0 and PCI_1, it supports 512Mbyte also on PCI_1. The
CPU PCI override feature enables larger PCI memory address space.
The CPU configuration register includes four PCI override bits - two bits per PCI_0 and two bits per PCI_1. Each
bit pair controls whether the PCI window is 2Gbyte, 1Gbyte, or the default.
Setting the PCI override bits are set to ‘01’, and SysAD bits[31:30] match bits [10:9] of the PCI Mem0 Low
decode address register, the transaction is directed to PCI Mem0. This effectively sets a 1Gbyte window in the
PCI memory address space.
NOTE: If Bits[31:30] do not match bits [10:9] of PCI Mem0 Low decode address register, the address is com-
pared against all other address decode registers.
When PCI override bits are set to ‘10’, and SysAD bit[31] matches bit [10] of the PCI Mem0 Low decode
address register, the transaction is directed to PCI Mem0. This effectively sets a 2Gbyte window to PCI.
NOTE: If bit[31] does not match bit [10] of PCI Mem0 Low decode address register, the address is compared
against all other address decode registers.
If PCI override bits are set to ‘00’ there is no PCI override (default address decoding).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| GT5-2/1S-HU | RECTANGULAR CONNECTOR |
| GT5-1S-HU(A) | RECTANGULAR CONNECTOR |
| GT5-1S-HU(B) | RECTANGULAR CONNECTOR |
| GT5-2S-HU | RECTANGULAR CONNECTOR |
| GT5-4S-HU | RECTANGULAR CONNECTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| GT96100AB3-BBF-C000 | 制造商:Marvell 功能描述:Marvell GT96100AB3-BBF-C000 |
| GT96100AB3-BBF-C083 | 制造商:Marvell 功能描述:Marvell GT96100AB3-BBF-C083 |
| GT96103AB3-BBF-C083 | 制造商:Marvell 功能描述: 制造商:Marvell 功能描述:Marvell GT96103AB3-BBF-C083 |
| GT96122-A2-BBF1C000 | 制造商:Marvell 功能描述:Marvell GT96122-A2-BBF1C000 |
| GT96122-Ax-BBF-C000 | 制造商:Marvell 功能描述:64-BIT MIPS COMMUNICATION CONTROLLER & INTEGRATED NETGX COPR - Trays |
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