- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄67672 > GT-96100A (Galileo Technology Services, LLC) Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) PDF資料下載
參數(shù)資料
| 型號： | GT-96100A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信協(xié)議的高級通信協(xié)議（以太網(wǎng)、快速以太網(wǎng)、HDLC）控制器) |
| 中文描述： | 先進的通信控制器能夠處理的串行通信協(xié)議，范圍廣，如以太網(wǎng)，快速以太網(wǎng)，和HDLC（通信協(xié)議的高級通信協(xié)議（以太網(wǎng)，快速以太網(wǎng)，HDLC的）控制器） |
| 文件頁數(shù)： | 516/549頁 |
| 文件大小： | 7321K |
| 代理商： | GT-96100A |
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GT-96100A Advanced Communication Controller
Revision 1.0
69
3.6.2
Writing to Decode Registers
When a LOW decode register is written to, the least significant 11 bits are written to the associated remap regis-
ter, simultaneously.
When a remap register is written to, only its contents are affected.
Following RESET, the default value of a remap register is equal to its associated LOW Decode register bits
[10:0].
Unless a specific write operation to a remap register takes place, a 1:1 mapping is maintained. Also, changing a
LOW Decode register’s contents automatically returns its associated space to a 1:1 mapping. This allows for
backward software compatibility with other Galileo Technology devices such as the GT-64010A and the GT-
64011 core logic devices.
3.6.3
PCI Address Remapping
The PCI slave interface has the ability to remap addresses of PCI transactions to memory using PCI remap regis-
ters. There are seven registers for PCI_0 and seven registers for PCI_1, if implemented.
These registers correspond to the following PCI Base Address Registers:
SCS[1:0]*
SCS[3:2]*
CS[2:0]*
CS[3]* & BootCS*
Swapped SCS[1:0]*
Swapped SCS[3:2]*
Swapped CS[3]* and BootCS*
These registers are listed in the Register Section as part of PCI Internal Registers, Section 7.14.1 “PCI Internal
Registers” on page 172. The offsets for these registers are 0xc48 - 0xc64. Each MAP register is 32-bits wide.
Each MAP register is 32-bits wide, where bits [12:0] are Read Only.
When an address is presented on the PAD lines, the address decoder in the PCI slave compares the PCI address to
its base/size registers. If there is a HIT in one of the seven Base Address registers listed above, then the address
undergoes remapping in accordance to the right Remap register in the non-masked address bits (by size register).
An example of this is summarized in Table 24.
Table 24: PCI Address Remapping Example
PCI address
0x1D98.7654
SCS[1:0]* BAR
0x1F00.0000
SCS[1:0]* Size
0x03FF.FFFF
SCS[1:0]* Remap Register
0x3F00.0000
Remapped PCI Address Presented to SDRAM
0x3D98.7654
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