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參數(shù)資料
| 型號： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號處理器 |
| 文件頁數(shù)： | 119/173頁 |
| 文件大?。?/td> | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
Lucent Technologies Inc.
DRAFT COPY
119
Pin Information
(continued)
42
35
40
34
38
79
88
77
80
81
83
84
85
87
89
IBF
OLD
ILD
DO
OCK
SYNC
EIBF
EOEB
EDO
EOFS
EOBC
EIBC
EIFS
EDI
EOBE
PB[15:8]
O
I/O SSIO Output Load
I/O SSIO Input Load
O
SSIO Data Output
I/O SSIO Output Clock
I
SSIO Bit Counter Sync
O
ESIO Input Buffer Full
I
ESIO Data Output Enable
ESIO Data Output
I
ESIO Output Frame Sync
I
ESIO Output Bit Clock
I
ESIO Input Bit Clock
I
ESIO Input Frame Sync
I
ESIO Data Input
O
ESIO Output Buffer Empty
I/O
§§
PHIF16 Parallel I/O Data Bus
15—8
I/O PHIF16 Parallel I/O Data Bus
7—0
O
PHIF16 Output Buffer Empty
O
PHIF16 Input Buffer Full
I
PHIF16 Output Data Strobe
I
PHIF16 Input Data Strobe
I
PHIF16 Peripheral Byte
Select (8-bit external mode)
I
PHIF16 Peripheral Status
Register Select
I
PHIF16 Peripheral Chip
Select Not
P
Ground
SSIO Input Buffer Full
3-state
3-state
3-state
3-state
3-state
—
3-state
—
3-state
—
—
—
—
—
3-state
3-state
logic low
configured as input
configured as input
3-state
configured as input
—
logic low
—
3-state
—
—
—
—
—
logic high
3-state
45, 46, 47, 48,
50, 51, 52, 53
57, 58, 59, 60,
62, 63, 64, 65
68
69
70
76
71
PB[7:0]
3-state
3-state
POBE
PIBF
PODS
PIDS
PBSEL
3-state
3-state
—
—
—
logic high
logic low
—
—
—
74
PSTAT
—
—
75
PCSN
—
—
19, 36, 43, 56,
67, 73, 90, 103,
109, 122, 133,
144
16, 28, 37, 49,
61, 72, 82, 97,
108, 115, 128,
138
4
1
During and after reset, the internal clock is selected as the CKI input pin and the CKO output pin is selected as the internal clock.
This pin his internal pull-up circuitry.
§
3-states by JTAG control.
The
ioc
register (see
Table 54 on page 99
) is cleared after reset, including its EBIO field that controls the multiplexing of the VEC0/IOBIT7,
VEC1/IOBIT6, VDC2/IOBIT5, and VEC3/IOBIT4 pins. After reset, these pins are configured as the VEC[3:0] outputs and are logic high.
If unused, this pin must be pulled low through a 10 k
resistor to V
SS
.
§§ 3-states if RSTB = 0 or
PHIFC
[PCFIG] = 0.
V
SS
—
—
V
DD
P
Power Supply
—
—
V
DDA
V
SSA
P
P
Analog Power Supply
Analog Ground
—
—
—
—
Table 80. Pin Descriptions
(continued)
TQFP Pin
Symbol
Type
Name/Function
Pin State During Reset
(RSTB = 0)
Pin State After
Reset
(RSTB 0
→
1)
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PDF描述 |
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| DSP1627F32K11IR | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP|16-BIT|CMOS|QFP|100PIN|PLASTIC |
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