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參數(shù)資料
| 型號(hào)： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號(hào)處理器 |
| 文件頁數(shù)： | 160/173頁 |
| 文件大?。?/td> | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
160
DRAFT COPY
Lucent Technologies Inc.
Timing Characteristics and Requirements
(continued)
PHIF16
(continued)
Figure 45. PIBF and POBE Reset Timing Diagram
POBE and PIBF can be programmed to be active-high or active-low. They are shown active-high. The timing characteristic for active-low is the
same as for active-high
.
Figure 46. POBE and PIBF Disable Timing Diagram
Table 119. PHIF16 Timing Characteristics for PIBF and POBE Reset
Abbreviated Reference
t57
t58
Parameter
Min
—
3
Max
35
35
Unit
ns
ns
RSTB Disable to POBE/PIBF
(high to valid)
RSTB Enable to POBE/PIBF
(low to invalid)
After reset, POBE and PIBF always go to the levels shown, indicating output buffer empty and input buffer full. The DSP program, however,
may later invert the definition of the logic levels for POBE and PIBF. t57 and t58 continue to apply.
Table 120. PHIF16 Timing Characteristics for POBE and PIBF Disable
Abbreviated Reference
t59
Parameter
Min
—
Max
15
Unit
ns
CKO to POBE/PIBF Disable (high/low to disable)
RSTB
V
IH
–
V
IL
–
t58
t57
POBE
V
OH
–
V
OL
–
PIBF
V
OH
–
V
OL
–
5-4775 (F)
CKO
V
IH
–
V
IL
–
t59
t59
POBE
V
OH
–
V
OL
–
PIBF
V
OH
–
V
OL
–
5-4776 (F)
相關(guān)PDF資料 |
PDF描述 |
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