參數(shù)資料
型號(hào)： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級(jí)映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁(yè)數(shù)： 269/606頁(yè)
文件大?。?/td> 9520K
代理商： TMXF28155
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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
269
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 373. FRM_RSLR32, Receive Signaling Link Register 32 (COR)
* See
Table 371
for values of L and R.
Address
*
Bit
Name
Function
Reset
Default
0000
0x8LR20
15:12
FRM_R_HGAIS[3:0]
HG AIS Detection
. Indicates the detection of AIS in the
corresponding HG.
FRM_R_HGA[3:0]
HG Alignment
. Indicates the alignment status for the cor-
responding HG. A 0 indicates no alignment. A 1 indicates
alignment for the corresponding group.
FRM_R_HGRDI[3:0]
HG RDI.
Indicates the detection of three consecutive
zeros in the Sp bit position of the corresponding HG.
FRM_R_TS16A
Time Slot 16 Multiframe Alignment Status
. A 0 indi-
cates that currently, time slot 16 multiframe alignment is
not established. A1 indicates that currently, time slot 16
multiframe alignment has been established.
FRM_R_TS16AIS
Time Slot 16 AIS Detection Status
. If time slot 16 multi-
frame alignment is lost, this bit will reflect the detection of
AIS in time slot 16.
—
Reserved.
Must write to 0.
11:8
0000
7:4
0000
3
0
2
0
1:0
0
Table 374. FRM_RSLR33, Receive Signaling Link Register 33
(
R/W)
Address
*
Bit
Name
Function
Reset
Default
0
0x8LR21
15
FRM_R_FZCON
Freeze Conversion.
When set to1, this enables the conver-
sion of certain signaling codes when the signaling buffers
have been frozen. The code translation is 00 to 01 and 0000
to 0101 for 4-state and 16-state signaling, respectively.
Reserved.
Must write to 0.
Signaling Insertion.
A 1 enables the insertion of signaling
data into the Tx line. A 0 disables the insertion of signaling
data into the Tx line. This bit is valid in the Rx path only when
in transport mode; otherwise, it should be set to 0.
Rx Path Stomping
. For DS1 links, this bit indicates to stomp
all robbed bit signaling on voice time slots on the correspond-
ing link. Stomping of time slot 16 for CEPT links is performed
in the system interface block.
1 = Will enable stomping.
0 = Will disable stomping for the corresponding link.
Reserved.
Must write to 0.
Signaling Debounce
.This bit enables signal debounce on
signaling when extracted from the Rx line.
Handling Group Enable
. When set to 1 in combination with
selecting the source of signaling data to be the VT mapper,
this indicates to the signaling block that the signaling for this
link is byte sync mapped and uses the handling group format.
Manual Signaling Freeze.
Used to manually halt the signal-
ing register updates when the source of signaling data is
either the VT mapper or when the signaling is extracted from
the Rx line. A 1 halts the updates.
14:9
8
—
0
0
FRM_R_SIGI
7
FRM_R_RXSTOMP
6
5
—
FRM_R_SIGDEB
0
4
FRM_R_HGEN
0
3
FRM_R_MSIGFZ
0
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PDF描述
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