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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
299
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 422. FRM_ARLR2, Arbiter Link Register 2 (R/W)
(continued)
Address
*
Bit
Name
* See
Table 417
for values of L and P.
Table 423. FRM_ARLR3, Arbiter Link Register 3 (R/W)
This register applies to the transmit path only.
* See
Table 417
for values of L and P
Function
Reset
Default
1011
0x8LPF1
3:0
FRM_MODE[3:0]
Framing Mode.
0000 = Nonalign 256 bit.
0001 = CEPT basic frame.
0010 = CEPT with CRC-4 and 100 ms timer.
0011 = CMI.
0100 = CEPT with CRC-4 and 400 ms timer.
0101 = Reserved. (Future J2 - G.704.)
0110
=
Reserved. (Future J2 - NTT Y.)
0111 = Reserved.
1000 = Nonalign 193 bits.
1001 = SF (FT bits only).
1010 = J-ESF.
1011 = ESF.
1100 = D4.
1101 = J-D4 (SF with Japanese Yellow Alarm).
1110 = DDS.
1111 = SLC-96.
Address
*
0x8LPF2
Bit
15
Name
Function
Reset Default
0
FRM_TP_CK_
SRC_EN
Framer Transmit Path Clock Source Enable.
0 = FRM_TP_CK_SRC bit is disabled. FRM_SW_TRN
(
Table 301
) bit controls clock source.
1 = FRM_TP_CK_SRC bit is enabled. FRM_SW_TRN bit
is ignored.
Transmit path clock and data is selected with bits
FRM_TP_CK_SRC and FRM_TP_DD_SRC.
Transmit Path Clock Source.
0 = Transmit clock comes from the frame aligner (transport
applications).
1 = Transmit clock comes from the system interface
(switching applications).
Transmit Path Default Data Source.
0 = Transmit data comes from the frame aligner (transport
applications).
1 = Transmit data comes from the system interface (switch-
ing applications).
Reserved.
Must write to 0.
System Frame Sync Mask.
A 1 masks the system frame
synchronization signal in the transmit framer formatter.
14
FRM_TP_CK_
SRC
1
13
FRM_TP_DD_
SRC
1
12:1
0
—
0000
FRM_SYSFSM
Note:
For those applications that have jitter on the transmit
clock signal relative to the system clock signal,
enable this bit so that the jitter is isolated from the
transmit framer.
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