參數(shù)資料
型號(hào)： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級(jí)映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁(yè)數(shù)： 410/606頁(yè)
文件大?。?/td> 9520K
代理商： TMXF28155
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TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Preliminary Data Sheet
May 2001
410
Agere Systems Inc.
18 SPE Mapper Functional Description
(continued)
I
The pointer interpreter transitions into the DEC state based on the following conditions:
—
When operating in the 8 of 10 mode (SPE_8ORMAJORITY = 1 (
Table 149
)), if 8 of the 10 I and D bits are
correct for a pointer decrement on the incoming H1 and H2 bytes, the pointer interpreter transitions into the
DEC state. Otherwise, if 3 of the 5 I bits and 3 of the 5 D bits are correct for a pointer decrement on the incoming
H1 and H2 bytes the pointer interpreter transitions into the DEC state.
I
The pointer interpreter transitions out of the DEC state based on the following conditions:
—
If NDF is enabled on the incoming H1 and H2 bytes, the pointer interpreter transitions from the DEC state into
the NDF state.
—
Following three consecutive frames with all ones in the H1 and H2 bytes, the pointer interpreter transitions from
the DEC state into the AIS-TU3 state.
—
Following three new consecutive, consistent, and valid pointers, the pointer interpreter transitions from the
DEC state into the NORM state.
—
Following any three consecutive, consistent, and valid pointers, the pointer interpreter transitions from the DEC
state into the NORM state.
—
Following the number of consecutive invalid pointers (determined by the value programmed in
SPE_CNTDLOPCNT[1:0]), the pointer interpreter transitions from the DEC state into the LOP-TU3 state.
I
Pointer increments and decrements will be counted and presented to the microprocessor as follows:
—
Pointer increments and decrements will be monitored and counted internally.
—
The internal and latched counts will be forced to 0x00 if device pin AUTO_AIS (AC6, AE6, and AD6) = 1 (from
TMUX), bit SPE_RLOP = 1 (
Table 148
), or bit SPE_RAIS = 1 (
Table 148
).
—
Latched counts, SPE_RPTR_INC[10:0] (
Table 161
) and SPE_RPTR_DEC[10:0] (
Table 161
), will be updated
coincident with the end of a performance monitor interval.
—
The internal counters will reset to 0x00 coincident with the end of a performance monitor interval.
—
If SMPR_SAT_ROLLOVER = 1 (
Table 67
), the internal running counts will hold at their maximum value. Oth-
erwise, the counts will roll over.
—
However, increment and decrement event indications should be ignored during LOP state.
I
LOP-TU3 (TU-3 path LOP) and AIS-TU3 (TU-3 path AIS) will be detected and reported to the microprocessor.
Both the LOP-TU3 and AIS-TU3 conditions will contribute to the AUTO AIS control signal from the SPE mapper
to the VT mapper. Any change in state of SPE_RLOP (
Table 148
) or SPE_RAIS (
Table 148
) will be reported to
the microprocessor via SPE_RLOPD (
Table 146
) and SPE_RAISD (
Table 146
). Unless the appropriate mask bit
is set (SPE_RLOPM/SPE_RAISM (
Table 147
)), SPE_RLOPD = 1 or SPE_RAISD = 1 will generate an interrupt.
I
The current TU-3 pointer value is stored in SPE_STORED_PTR[9:0] (
Table 161
).
18.14 SPE Mapper Receive Direction Requirements
All monitoring functions supported by the SPE mapper in the receive direction are summarized here:
I
Loss of CLOCK and loss of sync monitors
I
J1 monitor
I
B3 BIP-8 check
I
C2 signal label monitor
I
F2 monitor
I
F3 monitor
I
N1 monitor
I
K3 monitor
I
AIS-P and RDI-P detect
I
REI-P detect
I
Signal degrade BER algorithm
I
Signal fail BER algorithm
I
Path overhead access channel (POAC) drop
I
Insertion of AIS-P
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