參數(shù)資料
型號： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁數(shù)： 494/606頁
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代理商： TMXF28155
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TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Preliminary Data Sheet
May 2001
494
Agere Systems Inc.
21 28-Channel Framer Block Functional Description
(continued)
Table 580. Receive Signaling Link Registers 0
—
31 Expected Data
If the state mode is 4 state or 2 state, then the unused bits will be set to 0.
21.10 Optional Receive Signaling Features Provisioned for Each Link
21.10.1 Support of DS1 Robbed-Bit Stomping
The DS1 robbed-bit positions of voice time slots will be set to 1 in the payload when FRM_R_RXSTOMP in
FRM_RSLR33, Receive Signaling Link Register 33 (R/W),
Table 374 on page 269
, bit 7 is set to 1. The robbed-bit
positions in the payload will be stomped; however, the signaling will be transmitted untouched by the system inter-
face.
21.10.2 Support of CEPT Time Slot 16 Stomping
Stomping of time slot 16 for CEPT links is enabled in the system interface block.The Super Mapper can also be
configured to transmit AIS on the system bus in time slot 16 when the signaling block loses time slot 16 alignment.
The configuration bits related to these two features are located in the FRM_SYSLR2, System Interface Link Regis-
ter 2 (R/W),
Table 419 on page 294
. When using these features, the signaling codes forwarded to the transmit sys-
tem bus will continue to reflect the contents of FRM_RSLR0
—
FRM_RSLR31, Receive Signaling Link Registers
0
—
31 (R/W),
Table 372 on pag e268
.
21.10.3 Support of Signaling Debounce
If programmed to do so, the signaling extracted from the selected source will be debounced. This implies that a
valid signaling code would have to be detected twice before it is updated in FRM_RSLR0
—
FRM_RSLR31, Receive
Signaling Link Registers 0
—
31 (R/W),
Table 372 on page268
. This feature is enabled by setting FRM_R_SIGDEB
in FRM_RSLR33, Receive Signaling Link Register 33 (R/W),
Table 374 on page269
, bit 5.
21.10.4 Support of Japanese Handling Groups
If the signaling is transported by the VT mapper within four handling groups compliant to the Japanese standard,
TTC JT G.704, then FRM_R_HGEN in FRM_RSLR33, Receive Signaling Link Register 33 (R/W),
Table 374 on
page 269
, bit 4 must be set to 1. The signaling state mode must be set to either 2 state or no-signaling when using
handling groups.
If the signaling transported by the VT mapper uses handling groups, then the status of the handling group align-
ment can be transmitted across the system interface. The transmission of this status is enabled by setting
FRM_R_TSAISHG in FRM_SGR1, Receive Signaling Global Register 1 (R/W),
Table 359 on page 262
, bits 15 to
1. This mode forces the signaling data for the channels contained in each handling group to 1 if HG alignment has
not been achieved by the receive signaling processor. For example, if HG2 is unaligned then the A bit for time slots
2, 6, 10, 14, 18, and 22 forwarded to the system would be forced to 1.
21.11 Receive Signaling Global Feature Provisioning
The receive signaling processor requires the provisioning of one global item in order to enable signaling extraction
and delivery.
I
Link count (number of active receive links).
Signaling State Mode
16 state
4 state
2 state
Bit 6
0
0
1
Bit 5
0
1
1
Bit 4
0
0
0
Bit 3
D
0
0
Bit 2
C
0
0
Bit 1
B
B
0
Bit 0
A
A
A
相關PDF資料
PDF描述
TMXF84622 TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
TN2-L-H-3V SLIM POLARIZED RELAY
TN2-L-H-48V SLIM POLARIZED RELAY
TN2-L-H-4V SLIM POLARIZED RELAY
TN2-L-H-5V SLIM POLARIZED RELAY
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TMXF84622 制造商:AGERE 制造商全稱:AGERE 功能描述:TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
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