參數(shù)資料
型號: Am79C965A
廠商: Advanced Micro Devices, Inc.
英文描述: PCnet?-32 Single-Chip 32-Bit Ethernet Controller
中文描述: PCnet?-32單芯片32位以太網(wǎng)控制器
文件頁數(shù): 123/228頁
文件大小: 1681K
代理商: AM79C965A
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Am79C965A
123
S_RESET will RESET all of or some portions of CSR0,
3, 4, 15, 80, 100 and 124 to default values. S_RESET
will RESET
NONE
of the BCR locations to default
values. S_RESET will cause the microcode program to
jump to its RESET state. Following the end of the
S_RESET operation, the PCnet-32 controller will NOT
attempt to read the EEPROM device. See also the sub-
section on RESET Register in the I/O Register Access
section under Software Access. The S_RESET opera-
tion will not cause INTR pins to become inactive.
S_RESET will set the T-MAU into Link Fail state.
Note that S_RESET will
not
cause a de-assertion of
the HOLD signal, if it happens to be active at the time
of the read to the reset register. The HOLD signal will
remain active until the HLDA signal is synchronously
sampled as asserted. Following the read of the RESET
register, on the next clock cycle after the HLDA signal
is synchronously sampled as asserted, (except in
Am386 mode, when two cycles are needed) the PCnet-
32 controller will de-assert the HOLD signal; No bus
master accesses will have been performed during this
brief bus ownership period.
STOP
STOP is a PCnet-32 RESET operation that has been
created by the ASSERTION of the STOP bit in CSR0.
That is, a STOP RESET is generated by writing a ONE
to the STOP bit of CSR0
when the STOP bit currently
has a value of ZERO.
If the STOP bit value is currently
a ONE, and a ONE is rewritten to the STOP bit, then
NO STOP RESET will be generated. The STOP
operation will not cause INTR pins to become inactive.
STOP will RESET all or some portions of CSR0, 3, and
4 to default values; STOP will RESET
NONE
of the
BCR locations to default values. STOP will cause the
microcode program to jump to its RESET state. Follow-
ing the end of the STOP operation, the PCnet-32 con-
troller will not attempt to read the EEPROM device. For
the identity of individual CSRs and bit locations that are
affected by STOP, see the individual CSR register
descriptions. Setting the STOP bit does not affect the
T-MAU.
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